[发明专利]一种人构性高介电常数的介电薄膜及其制备方法有效
申请号: | 201810852884.1 | 申请日: | 2018-07-30 |
公开(公告)号: | CN108962725B | 公开(公告)日: | 2022-10-18 |
发明(设计)人: | 吴春亚;以色列·米加;李昀儒 | 申请(专利权)人: | 美国麦可松科技有限公司 |
主分类号: | H01L21/02 | 分类号: | H01L21/02 |
代理公司: | 南京知识律师事务所 32207 | 代理人: | 李媛媛 |
地址: | 美国得克萨斯州*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 一种 人构性高 介电常数 薄膜 及其 制备 方法 | ||
1.一种人构性高介电常数的介电薄膜,其特征在于,该介电薄膜包括多个周期性重叠的子薄膜单元,每个子薄膜单元由低漏电材料的子薄膜与高介电材料的子薄膜重叠构成,每一层子薄膜的厚度均小于1nm;所述介电薄膜的最底层和最上层均为低漏电材料的子薄膜;所述低漏电材料的子薄膜采用一种或者多种不同材料,其漏电流密度小于1×10-3A/cm2;所述高介电材料的子薄膜采用一种或者多种不同材料,其相对介电常数大于30;所述介电薄膜采用三种以上不同材料,每个子薄膜单元中,各子薄膜由最底层按漏电流先递增再递减的顺序排列,或按禁带宽度先递减再递增的顺序排列。
2.根据权利要求1所述的一种人构性高介电常数的介电薄膜,其特征在于,每个子薄膜单元中,最底层的子薄膜为介电常数最小的子薄膜。
3.根据权利要求1或2所述的一种人构性高介电常数的介电薄膜,其特征在于,所述低漏电材料的子薄膜采用本征的或掺杂的氧化铪、硅酸铪、氧化锆、硅酸锆、钆酸镧、氧化硅、氮化硅、氮氧化硅、氧化钽或以它们为基础的合金、混晶中的一种或者多种;所述高介电材料的子薄膜采用本征的或掺杂的氧化钛或以其为基础的合金、混晶中的一种或者多种。
4.根据权利要求1或2所述的一种人构性高介电常数的介电薄膜,其特征在于,所述介电薄膜的下表面、上表面、或分别在其上表面和下表面设有一层几纳米厚的漏电流阻挡层;所述漏电流阻挡层采用无机氧化物材料或有机自组装单分子层材料。
5.一种人构性高介电常数的介电薄膜的制备方法,其特征在于,包括如下步骤:
(1)在基底上生长厚度小于1nm的低漏电材料的子薄膜,然后在该子薄膜上生长厚度小于1nm的高介电材料的子薄膜;
(2)重复操作步骤(1),交替沉积低漏电材料的子薄膜和高介电材料的子薄膜;所述低漏电材料的子薄膜采用一种或者多种不同材料,其漏电流密度小于1×10-3A/cm2;所述高介电材料的子薄膜采用一种或者多种不同材料,其相对介电常数大于30;所述介电薄膜采用三种以上不同材料,每个子薄膜单元中,各子薄膜由最底层按漏电流先递增再递减的顺序排列,或按禁带宽度先递减再递增的顺序排列;
(3)最终在高介电材料的子薄膜上生长厚度小于1nm的最上层低漏电材料的子薄膜,从而形成人构性高介电常数的介电薄膜。
6.根据权利要求5所述的制备方法,其特征在于,步骤(2)的每个子薄膜单元中,最底层为介电常数最小的子薄膜。
7.根据权利要求5或6所述的制备方法,其特征在于,在所述介电薄膜的下表面、上表面、或分别在其上表面和下表面再沉积一层几纳米厚的漏电流阻挡层;所述漏电流阻挡层采用无机氧化物材料或有机自组装单分子层材料。
8.根据权利要求7所述的制备方法,其特征在于,所述无机氧化物材料为采用原子层方法或化学气相方法沉积的本征的或掺杂的氧化铪、硅酸铪、氧化锆、硅酸锆、钆酸镧、氧化硅、氮化硅、氮氧化硅、氧化钽或以它们为基础的合金、混晶中的一种或者多种。
9.根据权利要求7所述的制备方法,其特征在于,所述有机自组装单分子层材料采用磷酸正十八酯、1-十四基磷酸、1-癸基磷酸或1-丁基磷酸形成的自组装单分子层。
10.如权利要求1所述一种人构性高介电常数的介电薄膜的应用,其特征在于,所述介电薄膜用于SiC、 GaN、InGaZnO或Si 的MOSFET、薄膜晶体管、氧栅或能量存储器。
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H01L 半导体器件;其他类目中不包括的电固体器件
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H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造