[发明专利]将高速多通道链路中的通道与互连之间的训练模式序列解相关有效
申请号: | 201811176643.6 | 申请日: | 2014-03-03 |
公开(公告)号: | CN109617572B | 公开(公告)日: | 2021-12-10 |
发明(设计)人: | K·C·拉斯特德;A·O·兰 | 申请(专利权)人: | 英特尔公司 |
主分类号: | H04L25/02 | 分类号: | H04L25/02;H04B3/40;H04L5/14 |
代理公司: | 上海专利商标事务所有限公司 31100 | 代理人: | 姬利永;张欣 |
地址: | 美国加利*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 高速 通道 中的 互连 之间 训练 模式 序列 相关 | ||
用于将用于高速链路和互连的训练模式序列解相关的方法、装置和系统。高速链路和互连在每个方向采用多条通道用于发射和接收数据,并且可经由中间板(诸如背板或中间板)中的信号路径或者经由线缆物理地实现。在链路训练期间,在每个通道上发送包括伪随机位序列(PRBS)的训练模式。用于每条通道的PRBS由PRBS生成器基于对该通道而言唯一的PRBS多项式生成。由于每条通道采用不同的PRBS多项式,通道之间的训练模式可基本上是不相关的。可在链路端点之间执行链路协商以便确保用于高速链路或互连中的所有通道的PRBS多项式是唯一的。示例性使用包括以太网链路、无限带宽链路和多通道串行互连。
本申请是国际申请日为2014年03月03日、中国国家阶段申请号为201480008367.6、题为“将高速多通道链路中的通道与互连之间的训练模式序列解相关”的发明专利申请的分案申请。
技术领域
本发明的领域总体上涉及高速多通道链路和互连并且更具体地但是不排他地涉及用于将用于这种链路和互连的训练模式序列解相关的技术。
背景技术
自从引入了微处理器,计算机系统已经变得越来越快。近似根据摩尔定律(基于公司共同奠基人戈登·摩尔(Gordon Moore)于1965公开的预测集成电路上的晶体管数量将每两年翻倍),速度增加已经在近三十年来以相对平滑的速率上升。同时,存储器和非易失性存储设备两者的大小也已经稳定地增加,从而使得今天的许多个人计算机变得比仅仅10-15年前的超级计算机更强大。此外,网络通信的速度已经同样看到了天文数字增长。
处理器速度、存储器、存储设备和网络带宽技术的增长已经导致用更大量的容量构建和部署网络。最近,基于云的服务的引入(诸如亚马逊(例如,亚马逊弹性计算云(EC2)和简单存储服务(S3))和微软(例如,Azure和Office 365)所提供的那些)已经导致公共网络基础设施的附加网络构建,除部署大量数据中心以便支持采用私人网络基础设施的这些服务之外。
典型的数据中心部署包括大量的服务器机架,其各自容纳多个机架服务器或刀片服务器。机架服务器之间的通信通常是使用铜线线缆上以太网协议(IEEE 802.3)促成的。除使用线缆的选项之外,刀片服务器和网络交换机和路由器可被配置成用于支持机架中的刀片或卡之间的通过电背板或中间板互连的通信。
近年来,铜布线上的以太网连接的速度已经达到10吉比特每秒(Gpbs)和40Gpbs的水平。而且,IEEE(电子电气工程师协会)当前正在开发定义被称为100GBASE-KR4的目标为电背板上的100Gpbs带宽的新背板PHY(物理层)类型的规范(IEEE 802.3bj),其损耗在7GHz处高达33dB。被称为100GBASE-CR4的用于新100Gpbs铜线连接的类似规范也正在由IEEE定义。
高速链路和互连操作的重要方面是链路训练。在链路训练期间,训练信号模式从链路的第一端处的发射端口(即,第一端点)发射到另一个(第二)链路端点处的接收端口。除其他特征之外,训练模式促成调谐(例如,定时调整、电压信号电平)链路发射器/接收器对以便解决可导致数据错误的信号噪声等等。以类似的方式和通常并发地,链路训练也可在第二链路端点处的发射器和第一端点处的接收器之间执行。对于某些高速链路,链路或互连在每个方向包括多条通道,并且训练模式通过每条通道传输。
附图说明
当结合附图时,前述方面和本发明的许多伴随优势将变得更加容易认识到,正如通过参照以下详细描述更好地理解到的那样,其中,贯穿各种视图,相同的参考标号指代相同的部件,除非另外指明:
图1是根据一个实施例示出100GBASE-KR4链路的结构的示意图;
图1a示出图1的100GBASE-KR4链路,并且进一步描绘远端串扰(FEXT)和近端串扰(NEXT)的示例;
图2a示出用于一个方向的100GBASE-CR4链路的物理介质依赖(PMD)子层链路框图;
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