[发明专利]包括多数据速率存储器设备的存储设备以及存储器控制器在审

专利信息
申请号: 201811176706.8 申请日: 2018-10-10
公开(公告)号: CN109753458A 公开(公告)日: 2019-05-14
发明(设计)人: 金贤愚;安锡源;尹灿湖 申请(专利权)人: 三星电子株式会社
主分类号: G06F13/16 分类号: G06F13/16
代理公司: 北京市柳沈律师事务所 11105 代理人: 邵亚丽
地址: 韩国*** 国省代码: 韩国;KR
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摘要:
搜索关键词: 存储 存储器控制器 第一数据 数据选通信号 定时信息 访问信息 子控制器 选通 存储访问信息 收发数据信号 存储器接口 速率存储器 存储设备 选通信号 查找表 速率和 延迟
【权利要求书】:

1.一种存储器控制器,其被配置成控制以第一数据速率操作的第一存储块和以不同于所述第一数据速率的第二数据速率操作的第二存储块,所述存储器控制器包括:

存储器接口,其被配置成与所述第一存储块和所述第二存储块收发数据信号和数据选通信号;以及

子控制器,其包括存储访问信息的延迟查找表,所述访问信息包括限定提供给所述第一存储块的第一数据选通信号的第一选通调整定时信息以及限定提供给所述第二存储块的第二数据选通信号的第二选通调整定时信息。

2.如权利要求1所述的存储器控制器,其中以由所述访问信息限定的有序次序将所述第一数据选通信号提供给所述第一存储块以及将所述第二数据选通信号提供给所述第二存储块。

3.如权利要求2所述的存储器控制器,其还包括:

生成参考时钟信号的时钟发生器,其中所述第一选通调整定时信息是应用到所述参考时钟信号以限定所述第一数据选通信号的第一时间延迟,并且所述第二选通调整定时信息是应用到所述参考时钟信号以限定所述第二数据选通信号的不同于所述第一时间延迟的第二时间延迟。

4.如权利要求3所述的存储器控制器,其中所述参考时钟信号的频率等同于所述第一数据选通信号的频率。

5.如权利要求1所述的存储器控制器,其中所述存储器接口包括单个主延迟锁定环(DLL)电路和单个从DLL电路。

6.如权利要求1所述的存储器控制器,其中所述子控制器包括先进先出(FIFO),并且所述存储器控制器被配置成响应于存储在所述FIFO中的关于所述第一操作速度的访问信息和关于所述第二操作速度的访问信息顺序地控制所述第一存储块和所述第二存储块的操作。

7.如权利要求1所述的存储器控制器,其中所述第一存储块是存储设备并且所述第二存储块是存储器中的处理器(PIM)。

8.一种存储设备,其包括:

第一存储块,其具有第一操作速度;

第二存储块,其具有不同于所述第一操作速度的第二操作速度;

存储器控制器,其被配置成控制所述第一存储块和所述第二存储块的操作;以及

通道,其被配置成将所述存储器控制器与所述第一存储块和所述第二存储块连接,

其中所述存储器控制器包括:

存储器接口,其被配置成通过所述通道与所述第一存储块和所述第二存储块收发数据信号和数据选通信号;以及

子控制器,其被配置成存储关于所述第一操作速度和所述第二操作速度的访问信息,

其中所述访问信息由所述子控制器顺序地提供给所述存储器接口。

9.如权利要求8所述的存储设备,其中所述子控制器包括存储所述访问信息的先进先出(FIFO),并且

所述存储器控制器进一步被配置成基于所述访问信息被存储在所述FIFO中的顺序来顺序地控制所述第一存储块的操作并随后控制所述第二存储块的操作。

10.如权利要求8所述的存储设备,其还包括:

处理器,其被配置成控制访问信息至所述子控制器的输入和访问信息从所述子控制器的输出。

11.如权利要求10所述的存储设备,其中所述处理器被配置成接收限定针对所述第一存储块的第一操作的第一命令和限定针对所述第二存储块的第二操作的第二命令,并且

所述第一操作具有比所述第二操作更高的操作优先级。

12.如权利要求11所述的存储设备,其中所述处理器被配置成基于所述第一操作的操作优先级和所述第二操作的操作优先级将所述访问信息存储在所述子控制器中。

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