[发明专利]用于与时钟信号同步地发送和接收信号的半导体装置有效

专利信息
申请号: 201811415878.6 申请日: 2018-11-26
公开(公告)号: CN110299161B 公开(公告)日: 2023-04-25
发明(设计)人: 李昇宪;尹相植;张修宁;车镇烨 申请(专利权)人: 爱思开海力士有限公司
主分类号: G11C7/22 分类号: G11C7/22
代理公司: 北京弘权知识产权代理有限公司 11363 代理人: 许伟群;郭放
地址: 韩国*** 国省代码: 暂无信息
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摘要:
搜索关键词: 用于 时钟 信号 同步 发送 接收 半导体 装置
【说明书】:

本发明提供一种用于与时钟信号同步地发送和接收信号的半导体装置。半导体装置包括发送器件和接收器件。发送器件与时钟信号同步地从发送信号生成输出信号。接收器件基于半导体装置的操作速度,与时钟信号和延迟时钟信号同步地从输出信号来生成接收信号,所述延迟时钟信号是通过将时钟信号延迟预设时间而生成。

相关申请的交叉引用

本申请要求2018年3月21日向韩国知识产权局提交的申请号为10-2018-0032540的韩国专利申请的优先权,其全部内容通过引用合并于此。

技术领域

各种实施例总体而言涉及集成电路技术,并且更具体地,涉及用于半导体装置的信号发送和接收。

背景技术

每种电子装置可以包括大量电子部件。例如,计算机系统可以包括大量由半导体构成的半导体装置。构成计算机系统的半导体装置可以与时钟信号同步地操作。不仅在半导体装置的内部电路之间,而且在一个半导体装置与另一个半导体装置之间,可以与时钟信号同步地发送和接收各种同步信号。随着计算机系统的操作速度的增加,半导体装置的操作速度也增加。例如,时钟信号的频率增加,使得半导体装置可以以高速操作。

随着时钟信号的频率增加,与要发送和要接收的时钟信号同步的同步信号所需的时间余量逐渐减小。发送同步信号的发送器件和接收同步信号的接收器件可以通过信号传输线耦接。在传输同步信号的信号传输线中引起的延迟时间与在传输时钟信号的信号传输线中引起的延迟时间之间的差异可能进一步减小这样的时间余量。

发明内容

在一个实施例中,一种半导体装置可以包括:发送器件,其被配置为:与时钟信号同步地输出发送信号作为输出信号,并且基于操作信息信号,在第一时间和第二时间中的一个处输出所述输出信号,所述第二时间比所述第一时间更早;以及接收器件,其被配置为:接收所述输出信号和所述时钟信号,并且基于所述操作信息信号,通过将所述输出信号延迟与第三时间和第四时间中的一个相对应的时间来生成接收信号,所述第四时间比所述第三时间更长。

在一个实施例中,一种半导体装置可以包括:发送器件,其被配置为与时钟信号同步地从发送信号生成输出信号;以及接收器件,其被配置为接收所述输出信号和所述时钟信号,并且与所述时钟信号和延迟时钟信号同步地从所述输出信号来生成接收信号,所述延迟时钟信号是通过将所述时钟信号延迟预设时间而生成。

在一个实施例中,一种半导体装置可以包括:发送器件,其被配置为:与时钟信号相对应地发送输出信号,当所述半导体装置以低频操作时在第一时间发送所述输出信号,并且当所述半导体装置以高频操作时在第二时间发送所述输出信号,所述第二时间比所述第一时间点更早,所述高频比所述低频更高;以及接收器件,其被配置为:接收所述时钟信号和所述输出信号,当所述半导体装置以低频操作时通过将所述输出信号与所述时钟信号同步来生成所述接收信号,并且当所述半导体装置以高频工作时通过将所述输出信号与延迟时钟信号同步来生成所述接收信号,所述延迟时钟信号是通过将所述时钟信号延迟预设时间而生成。

在一个实施例中,一种半导体系统可以包括:第一半导体电路,其被配置为与时钟信号同步地生成输出信号;以及第二半导体电路,其被配置为接收所述输出信号和所述时钟信号,并且与延迟时钟信号同步地从所述输出信号生成接收信号,所述延迟时钟信号是通过将所述时钟信号延迟预设时间而生成。

附图说明

图1是说明根据一个实施例的半导体装置的配置的示例表示的图。

图2是说明根据一个实施例的半导体装置的配置的示例表示的框图。

图3是说明根据一个实施例的半导体装置的配置的示例表示的图。

图4是说明根据一个实施例的半导体系统的配置的示例表示的图。

图5是说明根据一个实施例的半导体装置的配置的示例表示的图。

具体实施方式

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