[发明专利]包括时钟发生电路的半导体器件有效

专利信息
申请号: 201811589714.5 申请日: 2018-12-25
公开(公告)号: CN110198162B 公开(公告)日: 2023-02-21
发明(设计)人: 朴明宰;金支焕 申请(专利权)人: 爱思开海力士有限公司
主分类号: H03K5/135 分类号: H03K5/135;G01R31/26;G01R23/02
代理公司: 北京弘权知识产权代理有限公司 11363 代理人: 许伟群;郭放
地址: 韩国*** 国省代码: 暂无信息
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摘要:
搜索关键词: 包括 时钟 发生 电路 半导体器件
【权利要求书】:

1.一种时钟发生电路,包括:

频率检测器,其适用于:包括多个第一单元延迟器以产生内部时钟;以及产生计数信号,所述计数信号表示所述内部时钟在输入时钟的激活时段期间的跳变次数;

控制信号发生器,其适用于基于目标信号和所述计数信号而产生多个周期控制信号,所述目标信号表示输出时钟的目标频率;以及

周期控制器,其适用于:包括多个第二单元延迟器以产生所述输出时钟,所述第二单元延迟器中的每个第二单元延迟器的延迟量与所述第一单元延迟器中的每个第一单元延迟器的延迟量基本相同;以及控制基于所述周期控制信号而被选中的所述第二单元延迟器的数量。

2.根据权利要求1所述的时钟发生电路,其中,所述第二单元延迟器的数量等于或大于所述第一单元延迟器的数量。

3.根据权利要求1所述的时钟发生电路,其中,所述频率检测器产生在所述输入时钟的激活时段结束时被激活的更新信号,以及

所述控制信号发生器基于所述更新信号而将所述目标信号与所述计数信号作比较。

4.根据权利要求3所述的时钟发生电路,其中,所述频率检测器包括:

多个第一单元延迟器,其串联耦接以形成用于产生所述内部时钟的反馈回路;

复位信号发生器,其适用于产生在所述输入时钟的激活时段结束后被激活的复位信号;以及

计数器,其适用于:通过对所述内部时钟在所述输入时钟的激活时段期间的跳变次数进行计数来产生所述计数信号,以及基于所述复位信号而将所述计数信号复位。

5.根据权利要求4所述的时钟发生电路,其中,所述频率检测器还包括:

分频器,其适用于:通过将所述输入时钟的频率分频来产生振荡时钟,以及为所述复位信号发生器提供所述振荡时钟;以及

更新信号发生器,其适用于将所述振荡时钟反相并输出所述更新信号。

6.根据权利要求1所述的时钟发生电路,其中,所述控制信号发生器基于如下等式来确定值X:

其中,CNT表示所述计数信号的值,而TARGET表示所述目标信号的值,以及

所述控制信号发生器产生用于选择所述第二单元延迟器的数量的所述周期控制信号,所述第二单元延迟器的数量对应于通过使所述第一单元延迟器的数量K与所述值X相乘而得到的值K*X。

7.根据权利要求1所述的时钟发生电路,其中,所述第二单元延迟器串联耦接以形成反馈回路,以及通过基于所述周期控制信号而选择性地接收前一级的第二单元延迟器的输出或所述输出时钟来产生所述输出时钟。

8.根据权利要求1所述的时钟发生电路,其中,所述第二单元延迟器中的每个第二单元延迟器包括:

多路复用器,其适用于基于所述周期控制信号之中的对应的周期控制信号而选择并输出前一级的第二单元延迟器的输出或所述输出时钟;以及

第三单元延迟器,其适用于延迟所述多路复用器的输出并输出所述多路复用器的已延迟的输出。

9.根据权利要求8所述的时钟发生电路,其中,所述第三单元延迟器的延迟量与所述第一单元延迟器中的每个第一单元延迟器的延迟量基本相同。

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