[实用新型]处理板卡有效
| 申请号： | 201821779509.0 | 申请日： | 2018-10-30 |
| 公开（公告）号： | CN208766659U | 公开（公告）日： | 2019-04-19 |
| 发明（设计）人： | 严寒;梁喆;侯丽丽 | 申请（专利权）人： | 北京旷视科技有限公司 |
| 主分类号： | G06F15/76 | 分类号： | G06F15/76;G06F13/40 |
| 代理公司： | 北京超凡志成知识产权代理事务所(普通合伙) 11371 | 代理人： | 王术兰 |
| 地址： | 100000 北京*** | 国省代码： | 北京;11 |
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| 摘要： | |||
| 搜索关键词： | 处理板卡 处理芯片 编解码器 芯片 交换机 电子设备领域 处理流程 集成封装 连接处理 主机连接 总线连接 总线 板卡 主机 互联 申请 | ||
1.一种处理板卡，其特征在于，所述处理板卡包括：处理芯片、交换机和PCIE接口；
所述处理芯片中集成封装了编解码器、FPGA和ARM，所述处理芯片内的所述编解码器、所述FPGA和所述ARM连接所述处理芯片内的总线；
所述交换机分别与主机、所述PCIE接口和所述处理芯片内的总线连接；
所述PCIE接口与所述主机连接。
2.根据权利要求1所述的处理板卡，其特征在于，
所述处理芯片内的所述编解码器、所述FPGA和所述ARM与所述处理芯片内的总线硬性连接。
3.根据权利要求2所述的处理板卡，其特征在于，
所述处理芯片内的总线为Axi总线。
4.根据权利要求1-3任一权利要求所述的处理板卡，其特征在于，
所述处理芯片上设有连接所述处理芯片内的总线的第一I/O端口；
所述交换机的第一网口与所述主机连接，所述交换机的第二网口与所述处理芯片的第一I/O端口连接，以及所述交换机的第三网口与所述PCIE接口连接。
5.根据权利要求4所述的处理板卡，其特征在于，
所述处理板卡还包括：网络接口；
所述交换机的第一网口与所述网络接口的第一接口连接，所述网络接口的第二接口用于与所述主机连接。
6.根据权利要求5所述的处理板卡，其特征在于，
所述处理板卡还包括：主板；
所述处理芯片、所述交换机、所述PCIE接口和所述网络接口均安装在所述主板上。
7.根据权利要求4所述的处理板卡，其特征在于，
所述PCIE接口包括：PCIE芯片和PCIE接口电路；
所述PCIE芯片的第一端口与所述交换机的第三网口连接，所述PCIE芯片的第二端口与所述PCIE接口电路的第一接口连接，所述PCIE接口电路的第二接口与所述主机连接。
8.根据权利要求1所述的处理板卡，其特征在于，
所述处理芯片上设有连接所述处理芯片内的总线的第二I/O端口；
所述处理板卡还包括：M个第一内存，M为大于等于1的整数；
所述M个第一内存与所述处理芯片的第二I/O端口连接。
9.根据权利要求8所述的处理板卡，其特征在于，
所述处理芯片上设有连接所述处理芯片内所述FPGA的第三I/O端口；
所述处理板卡还包括：N个第二内存，N为大于等于1的整数；
所述N个第二内存与所述处理芯片的第三I/O端口连接。
10.一种处理板卡，其特征在于，所述处理板卡包括：交换机、P个处理芯片和PCIE接口，其中，M为大于1的整数；
所述P个处理芯片中的每个处理芯片中集成封装了编解码器、FPGA和ARM，每个处理芯片内的编解码器、FPGA和ARM连接每个处理芯片内的总线；
所述交换机分别与主机、所述PCIE接口和每个处理芯片内的总线连接；
所述PCIE接口与所述主机连接。
11.根据权利要求10所述的处理板卡，其特征在于，
所述P个处理芯片中每个处理芯片上设有连接每个处理芯片内总线的第四I/O端口，所述P个处理芯片通过所述第四I/O端口进行通信。
12.根据权利要求11所述的处理板卡，其特征在于，
所述P个处理芯片通过所述第四I/O端口以USB方式、I2C方式、UART方式和/或SPI方式进行通信。
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