[实用新型]一种实现eMMC芯片HS400高速接口通信的系统有效
| 申请号： | 201821850500.4 | 申请日： | 2018-11-12 |
| 公开（公告）号： | CN208805808U | 公开（公告）日： | 2019-04-30 |
| 发明（设计）人： | 操飞;林峰;阴陶;戴荣 | 申请（专利权）人： | 成都傅立叶电子科技有限公司 |
| 主分类号： | G06F13/42 | 分类号： | G06F13/42;G06F11/10 |
| 代理公司： | 成都诚中致达专利代理有限公司 51280 | 代理人： | 曹宇杰 |
| 地址： | 610041 四川省成都*** | 国省代码： | 四川;51 |
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| 摘要： | |||
| 搜索关键词： | 时钟信号 字节数据 芯片 同步寄存器 高速接口 数据信号 延时单元 组连接 采集 输出 延时 数据通信功能 采集数据 初始延时 单元连接 范围变化 切换单元 数据采集 芯片连接 选择信号 翻转 上升沿 下降沿 读写 宽温 通信 统一 | ||
1.一种实现eMMC芯片HS400高速接口通信的系统，其特征在于，包括：
与eMMC芯片连接的延时单元组，用于设计时钟信号/数据信号的初始延时TAP，同步增加时钟信号/数据信号的延时TAP；
与延时单元组连接的IDDR单元，用于采集数据信号，在时钟信号上升沿输出奇数字节数据，在时钟信号下降沿输出偶数字节数据；
与IDDR单元连接同步寄存器组，其与IDDR输出端口的路径延时一致，用于使采集到的奇数字节数据与偶数字节数据同步输出；
与同步寄存器组连接的采集边沿切换单元，用于翻转采集边沿选择信号，切换当前延时TAP下的数据采集边沿。
2.根据权利要求1所述的实现eMMC芯片HS400高速接口通信的系统，其特征在于，延时单元组包括：
与eMMC芯片的数据引脚连接的第一延时单元，用于调节数据信号的输入延时时间，
与eMMC芯片的时钟引脚连接的第二延时单元，用于调节时钟信号的输入延时时间。
3.根据权利要求2所述的实现eMMC芯片HS400高速接口通信的系统，其特征在于，第二延时单元和IDDR单元之间的设有I/O时钟BUFFER单元，用于增强时钟信号的区域逻辑驱动能力，同时增加时钟信号的输入延时。
4.根据权利要求1所述的实现eMMC芯片HS400高速接口通信的系统，其特征在于，同步寄存器组由多个DFF构成。
5.根据权利要求4所述的实现eMMC芯片HS400高速接口通信的系统，其特征在于，同步寄存器组包括一级同步寄存单元和二级同步寄存单元。
6.根据权利要求5所述的实现eMMC芯片HS400高速接口通信的系统，其特征在于，一级同步寄存单元由4个DFF构成，二级同步寄存单元由3个DFF构成。
7.根据权利要求1所述的实现eMMC芯片HS400高速接口通信的系统，其特征在于，采集边沿切换单元为选择器MUX。
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