[发明专利]形成三维存储设备的栅极结构的方法有效

专利信息
申请号: 201880005286.9 申请日: 2018-06-04
公开(公告)号: CN110121774B 公开(公告)日: 2020-03-27
发明(设计)人: 徐强;夏志良;邵明;霍宗亮 申请(专利权)人: 长江存储科技有限责任公司
主分类号: H01L27/11521 分类号: H01L27/11521;H01L27/11551;H01L27/11568;H01L27/11578
代理公司: 北京永新同创知识产权代理有限公司 11376 代理人: 林锦辉
地址: 430074 湖北省武汉市东湖*** 国省代码: 湖北;42
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摘要:
搜索关键词: 形成 三维 存储 设备 栅极 结构 方法
【权利要求书】:

1.一种形成三维(3D)NAND存储设备的方法,包括:

在衬底上形成包括多个介电层对的交替绝缘体堆叠层,所述多个介电层对中的每个介电层对包括第一介电层和与所述第一介电层不同的第二介电层;

形成多个狭缝,每个狭缝垂直穿过所述交替绝缘体堆叠层并沿水平方向延伸;

通过所述多个狭缝去除所述交替绝缘体堆叠层中的所述多个第二介电层,以形成多个沟槽;

在所述多个沟槽中的每个沟槽中形成导体层;

在所述多个狭缝的侧壁上形成第一隔离层以覆盖所述导体层,以防止所述导体层被氧化,其中,所述第一隔离层具有多个凹槽;

在所述第一隔离层的表面上形成第二隔离层,所述第二隔离层的材料与所述第一隔离层的材料不同;以及

将导电材料沉积到所述狭缝中以形成多个导电壁,其中,所述多个导电壁与所述导体层绝缘。

2.如权利要求1所述的方法,其中,所述多个介电层对中的每个介电层对是由厚度在约10nm至约150nm范围内的氧化硅层和厚度在约10nm至约150nm范围内的氮化硅层形成的。

3.如权利要求1所述的方法,还包括:

形成多个沟道结构,每个沟道结构垂直穿过所述交替绝缘体堆叠层;

其中,所述多个狭缝中的每个狭缝在所述多个沟道结构之间水平延伸。

4.如权利要求1所述的方法,还包括:

在形成所述多个狭缝之后,在所述狭缝下方的所述衬底中形成多个掺杂区域,以使每个导电壁与相应的掺杂区域接触。

5.如权利要求1所述的方法,还包括:

形成包括硅、氮化硅、氧氮化硅或氧化铝的膜,作为所述第一隔离层,所述膜的厚度在约0.1nm至约10nm的范围内。

6.如权利要求1所述的方法,还包括:

形成硅膜作为所述第一隔离层;

形成氧化硅膜作为所述第二隔离层;以及

在形成所述第二隔离层的过程中,将至少一部分所述硅膜氧化成氧化硅。

7.如权利要求3所述的方法,其中,形成所述多个沟道结构包括:

形成垂直延伸穿过所述交替绝缘体堆叠层的沟道孔;

在所述沟道孔的侧壁上形成功能层;以及

形成覆盖所述功能层侧壁的沟道层。

8.如权利要求7所述的方法,其中,形成所述功能层包括:

在所述沟道孔的所述侧壁上形成阻挡层,用于阻挡电荷的流出;

在所述阻挡层的表面上形成存储层,用于在3D存储设备的操作期间存储电荷;以及

在所述存储层的表面上形成隧道层,用于隧穿电荷。

9.如权利要求1所述的方法,还包括:

在所述多个沟槽中形成所述导体层之前,在所述多个沟槽中形成绝缘层。

10.如权利要求9所述的方法,其中,形成所述绝缘层包括:

形成覆盖所述多个第一介电层的顶表面和底表面以及由所述多个沟槽暴露的功能层的外侧壁部分的第一绝缘子层;以及

形成厚度在约1nm至约10nm范围内的第二绝缘子层,以覆盖所述第一绝缘子层。

11.如权利要求10所述的方法,其中:

所述第一绝缘子层是通过沉积包括氧化铝的第一材料来形成的;以及

所述第二绝缘子层是通过沉积包括氮化钛的第二材料来形成的。

12.如权利要求9所述的方法,还包括:

在形成所述绝缘层之前,进行磷酸漂洗工艺以清洁所述多个沟槽,其中,所述磷酸漂洗工艺的漂洗温度在约100℃至约200℃的范围内,并且所述磷酸漂洗工艺的漂洗时间在约10分钟至约100分钟的范围内。

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