[发明专利]存储设备组及包括存储设备组的存储系统在审

专利信息
申请号: 201910088802.5 申请日: 2019-01-30
公开(公告)号: CN110580129A 公开(公告)日: 2019-12-17
发明(设计)人: 朴在根;郑铋用;沈昊俊;芮祥荣 申请(专利权)人: 三星电子株式会社
主分类号: G06F3/06 分类号: G06F3/06
代理公司: 11105 北京市柳沈律师事务所 代理人: 邵亚丽
地址: 韩国*** 国省代码: 韩国;KR
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摘要:
搜索关键词: 加密 存储设备 存储设备组 处理数据 逻辑芯片 控制器 可重构 配置处理 输出数据 主机通信 配置
【说明书】:

提供了一种存储设备组。该存储设备组包括存储设备和可重构逻辑芯片,该存储设备能够与主机通信并包括控制器,该控制器被配置为通过对数据进行加密来生成加密的输入数据;该可重构逻辑芯片被配置为从存储设备接收加密的输入数据、通过根据预定的配置处理加密的输入数据来生成已处理数据、并且通过对已处理数据进行加密来生成加密的输出数据。

相关申请的交叉引用

本申请要求于2018年6月7日在韩国知识产权局提交的韩国专利申请第10-2018-0065657号的权益,其公开内容通过引用整体并入本文。

技术领域

本发明构思的示例实施例涉及存储设备、包括该存储设备的存储系统和/或操作该存储设备的方法。例如,至少一些示例实施例涉及包括存储设备和可重构逻辑芯片的存储设备组、包括该存储设备组的存储系统和/或操作该存储设备的方法。

背景技术

为了提高存储系统的处理速度,可以向存储系统中添加加速器,加速器通过执行通常由主机执行的一些计算来辅助主机的计算。传统上,加速器可以是执行设置功能的专用硬件加速器,因此,主机可以支持全部数据流,而这可能导致主机的开销。

发明内容

近来,主机需要高速处理各种应用中的每一个。为了减少主机的开销,在一个或多个示例实施例中,可重构加速器可根据设计文件(例如,现场可编程门阵列(field-programmable gate array,FPGA))来重构以对应于各种应用。

本发明构思的一些示例实施例提供了一种包括存储设备和可重构逻辑芯片的存储设备组、包括该存储设备组的存储系统和/或操作该存储设备的方法,从而可以减少主机的开销。

根据本发明构思的示例实施例,提供了一种存储设备组,该存储设备组包括被配置为与主机通信的存储设备和可重构逻辑芯片。该存储设备包括被配置为通过对数据进行加密来生成加密的输入数据的控制器;该可重构逻辑芯片被配置为从存储设备接收加密的输入数据、通过根据配置处理加密的输入数据来生成已处理数据、并且通过对已处理数据进行加密来生成加密的输出数据。

根据本发明构思的另一示例实施例,提供了一种存储系统,该存储系统包括主机、可重构逻辑芯片和存储设备。该存储设备被配置为经由第一端口与主机通信,并且经由第二端口与可重构逻辑芯片通信,使得该存储设备被配置为经由第二端口将加密的输入数据发送到可重构的逻辑芯片,并且经由第二端口从可重构逻辑芯片接收加密的输出数据。

根据本发明构思的另一示例实施例,提供了一种操作存储设备的方法。该方法包括:经由存储设备的第一端口从主机接收包括数据处理请求的主机命令;经由存储设备的第二端口将加密的数据和命令对加密的数据进行数据处理的命令发送到可重构逻辑芯片;以及,经由存储设备的第二端口从可重构逻辑芯片接收加密的已处理数据。

附图说明

通过以下结合附图的详细描述,将更清楚地理解本发明构思的示例实施例,其中:

图1是示意性地示出根据示例实施例的存储系统的图;

图2是根据示例实施例的存储设备组的框图;

图3是根据示例实施例的操作存储设备的方法的流程图;

图4是示出图2的主机、存储设备和可重构逻辑芯片之间的操作的示例的流程图;

图5是示出图2的主机、存储设备和可重构逻辑芯片之间的操作的另一示例的流程图;

图6示出了图2所示的存储设备组的操作的示例;

图7是示出图6的控制器、缓冲存储器和可重构逻辑芯片之间的操作的流程图;

图8示出了图2所示的存储设备组的操作的另一示例;

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