[发明专利]针对超大带宽无线信道仿真实现精确延时处理的电路结构在审
| 申请号： | 201910099563.3 | 申请日： | 2019-01-31 |
| 公开（公告）号： | CN109743125A | 公开（公告）日： | 2019-05-10 |
| 发明（设计）人： | 刘景鑫;赵成成 | 申请（专利权）人： | 上海创远仪器技术股份有限公司 |
| 主分类号： | H04B17/391 | 分类号： | H04B17/391;H04B17/364;H04B17/10 |
| 代理公司： | 上海智信专利代理有限公司 31002 | 代理人： | 王洁;郑暄 |
| 地址： | 201601 上海*** | 国省代码： | 上海;31 |
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| 摘要： | |||
| 搜索关键词： | 延时模块 移位寄存器 电路结构 小数 输入端 无线信道仿真 带宽 信道模拟器 延时处理 低速时钟 多径延时 高速数据 功能需求 依次串联 输出 多相位 分辨率 输出端 小步 延时 | ||
1.一种针对超大带宽无线信道仿真实现精确延时处理的电路结构，其特征在于，所述的电路结构包括：
大步进延时模块组，包含多个大步进延时模块，所述的多个大步进延时模块的输出端和输入端依次串联，用于输出不同延时值的数据；
小步进整数延时模块组，包含多个多相位的移位寄存器，所述的各个移位寄存器的输入端分别与所述的多个大步进延时模块的输出端相连接，用于重新排布各相位的数据；
小数延时模块组，包含多个小数延时模块，所述的各个小数延时模块的输入端分别与所述的多个移位寄存器的输出端相连接，用于获取精度高的小数延时。
2.根据权利要求1所述的针对超大带宽无线信道仿真实现精确延时处理的电路结构，其特征在于，所述的大步进延时模块为双端口随机存储器或FIFO存储器，用于在大步进延时过程中进行数据存储。
3.根据权利要求1所述的针对超大带宽无线信道仿真实现精确延时处理的电路结构，其特征在于，所述的大步进延时模块通过块随机存储器构建双端口随机存储器或FIFO存储器。
4.根据权利要求1所述的针对超大带宽无线信道仿真实现精确延时处理的电路结构，其特征在于，所述的大步进延时模块的输出端与寄存器相连接，用于分割过长的数据传输路径。
5.根据权利要求1所述的针对超大带宽无线信道仿真实现精确延时处理的电路结构，其特征在于，所述的移位寄存器由多个寄存器串联连接。
6.根据权利要求1所述的针对超大带宽无线信道仿真实现精确延时处理的电路结构，其特征在于，所述的小数延时模块包含Farrow滤波器，用于对数据进行小数延时。
7.根据权利要求1所述的针对超大带宽无线信道仿真实现精确延时处理的电路结构，其特征在于，所述的大步进延时模块组将数据分为n路并行处理，其中，n为不小于2的任意整数。
8.根据权利要求7所述的针对超大带宽无线信道仿真实现精确延时处理的电路结构，其特征在于，所述的大步进延时模块的工作时钟为数据速率的n分之一。
9.根据权利要求7所述的针对超大带宽无线信道仿真实现精确延时处理的电路结构，其特征在于，所述的小步进整数延时模块通过移位寄存器长度和延时值计算得出小步进整数延时结果。
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