[发明专利]用于存储器的同时读取和预充电的系统、设备和方法在审

专利信息
申请号: 201910303718.0 申请日: 2019-04-16
公开(公告)号: CN110503990A 公开(公告)日: 2019-11-26
发明(设计)人: L·舒伯拉玛尼安;K·瓦德亚纳坦;A·诺丽;S·萨布拉蒙尼;T·卡尔尼克 申请(专利权)人: 英特尔公司
主分类号: G11C7/06 分类号: G11C7/06;G11C7/12;G11C11/4091;G11C11/4094
代理公司: 31100 上海专利商标事务所有限公司 代理人: 黄嵩泉;钱慰民<国际申请>=<国际公布>
地址: 美国加利*** 国省代码: 美国;US
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摘要:
搜索关键词: 感测放大器电路 存储器单元 内部节点 存储器阵列 缓冲器电路 耦合到 存储 均衡电路 耦合 去耦合 个位 感测 字线 放大 均衡
【权利要求书】:

1.一种设备,包括:

存储器阵列,具有:多个存储器单元;多个位线,耦合到所述多个存储器单元;以及多个字线,耦合到所述多个存储器单元;以及

感测放大器电路,用于感测和放大存储在所述多个存储器单元的存储器单元中的值,所述感测放大器电路包括:

缓冲器电路,用于存储所述值,所述缓冲器电路耦合在所述感测放大器电路的第一内部节点和所述感测放大器电路的第二内部节点之间;以及

均衡电路,用于在所述感测放大器电路与所述存储器阵列解耦时对所述第一内部节点和所述第二内部节点进行均衡。

2.如权利要求1所述的设备,其特征在于,所述均衡电路用于在激活操作的电荷共享阶段期间被启用。

3.如权利要求1所述的设备,进一步包括:隔离电路,用于可控制地将所述感测放大器电路相对于所述存储器阵列耦合和解耦。

4.如权利要求3所述的设备,进一步包括:预充电电路,所述预充电电路耦合到所述存储器阵列以对所述多个位线进行预充电。

5.如权利要求4所述的设备,其特征在于,所述预充电电路用于在在将读取存储在所述感测放大器电路中的信息时对所述多个位线进行预充电。

6.如权利要求5所述的设备,其特征在于,所述隔离电路用于在所述预充电电路对所述多个位线进行预充电之前,将所述感测放大器电路与所述存储器阵列进行解耦,所述隔离电路包括一个或多个晶体管,所述一个或多个晶体管被可切换地控制以将所述感测放大器电路与所述存储器阵列进行解耦,其中所述一个或多个晶体管具有长度基本上大于宽度的尺寸,以实现介质导通电阻。

7.如权利要求1所述的设备,其特征在于,所述均衡电路包括:

第一晶体管,耦合在所述第一内部节点和所述第二内部节点之间,所述第一晶体管基于感测使能信号的第二状态耦合所述第一内部节点和所述第二内部节点;以及

第二晶体管,耦合在所述第一内部节点和所述第二内部节点之间,所述第二晶体管基于互补感测使能信号的第一状态耦合所述第一内部节点和所述第二内部节点。

8.如权利要求7所述的设备,其特征在于,所述感测使能信号的第一状态是用于使得能够访问所述感测放大器电路。

9.如权利要求1所述的设备,进一步包括:耦合到所述存储器阵列的存储器控制器,其中,所述存储器控制器响应于读取请求而用于:

向所述存储器阵列发布组合的激活和预充电命令;以及

此后,向所述存储器阵列发布多个读取请求。

10.如权利要求9所述的设备,其特征在于,所述存储器阵列用于返回针对多个读取请求的多个数据响应,其中在响应所述组合的激活和预充电命令对所述多个位线进行预充电期间,所述多个数据响应中的至少一些将被发送。

11.如权利要求1所述的设备,进一步包括:耦合到所述存储器阵列的存储器控制器,其中,所述存储器控制器响应于写入请求而用于:

向所述存储器阵列发布激活命令;

此后,向所述存储器阵列发布一个或多个写入请求;以及

此后,向所述存储器阵列发布预充电命令。

12.一种方法,包括:

在存储器控制器中接收存储器访问请求;

确定从对耦合到所述存储器控制器的存储器行的最后一次激活操作到接收所述存储器访问请求的持续时间;

基于所述持续时间来更新所述存储器控制器的开放时间表;

计算所述开放时间表的多个条目的直方图信息;

至少部分地基于所述直方图信息和命中阈值来识别所述存储器的感测放大器的开放持续时间;以及

使所述存储器在所述开放持续时间之后关闭所述感测放大器。

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