[发明专利]半导体器件及其制造方法在审
申请号: | 201910490846.0 | 申请日: | 2019-06-06 |
公开(公告)号: | CN110581134A | 公开(公告)日: | 2019-12-17 |
发明(设计)人: | 泷泽直树;齐藤朋也 | 申请(专利权)人: | 瑞萨电子株式会社 |
主分类号: | H01L27/11519 | 分类号: | H01L27/11519;H01L27/11521;H01L27/11565;H01L27/11568;H01L29/423;H01L21/28 |
代理公司: | 11256 北京市金杜律师事务所 | 代理人: | 李辉 |
地址: | 日本*** | 国省代码: | 日本;JP |
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摘要: | |||
搜索关键词: | 存储器单元 存储器栅极电极 半导体器件 存储器区域 阈值电压 功函数 金属膜 代码区域 数据区域 分栅型 制造 | ||
1.一种半导体器件,包括:
半导体衬底,具有第一区域和第二区域;
第一突出,所述第一突出是所述半导体衬底的所述第一区域的一部分,从所述半导体衬底的上表面突出,并且沿着所述半导体衬底的所述上表面在第一方向上延伸;
第二突出,所述第二突出是所述半导体衬底的所述第二区域的一部分,从所述半导体衬底的所述上表面突出,并且沿着所述半导体衬底的所述上表面在第二方向上延伸;
第一栅极电极,经由包括第一电荷存储部分的第一绝缘膜,覆盖所述半导体衬底的、在所述第一区域中的所述上表面,并且覆盖所述第一突出的上表面和侧表面;
第一源极区域和第一漏极区域,形成在所述第一突出中以便在所述第一方向上将第一沟道形成区域夹在其间,所述第一沟道形成区域是在所述第一突出内部的区域、并且用包括所述第一栅极电极的图案覆盖;
第二栅极电极,经由包括第二电荷存储部分的第二绝缘膜,覆盖所述半导体衬底的、在所述第二区域中的所述上表面,并且覆盖所述第二突出的上表面和侧表面;以及
第二源极区域和第二漏极区域,形成在所述第二突出中,以便在所述第二方向上将第二沟道形成区域夹在其间,所述第二沟道形成区域是在所述第二突出内部的区域,并且用包括所述第二栅极电极的图案覆盖,
其中所述第一栅极电极、所述第一源极区域和所述第一漏极区域配置第一非易失性存储器单元,
其中所述第二栅极电极、所述第二源极区域和所述第二漏极区域配置第二非易失性存储器单元,
其中所述第一栅极电极包括第一金属膜,所述第一金属膜具有与所述第一沟道形成区域的功函数不同的第一功函数,
其中所述第二栅极电极包括第二金属膜,所述第二金属膜具有与所述第二沟道形成区域的功函数不同的第二功函数,并且
其中所述第一功函数和所述第二功函数彼此不同。
2.根据权利要求1所述的半导体器件,其中所述第一金属膜和所述第二金属膜中的每个金属膜分别包括多个金属膜。
3.根据权利要求1所述的半导体器件,其中所述第一金属膜的厚度大于所述第二金属膜的厚度。
4.根据权利要求1所述的半导体器件,还包括:
第三栅极电极,与所述第一栅极电极相邻,并且经由第三绝缘膜覆盖所述第一突出的所述上表面和侧表面;以及
第四栅极电极,与所述第二栅极电极相邻,并且经由第四绝缘膜覆盖所述第二突出的所述上表面和侧表面,
其中所述第一栅极电极、所述第三栅极电极、所述第一源极区域和所述第一漏极区域配置所述第一非易失性存储器,并且
其中所述第二栅极电极、所述第四栅极电极、所述第二源极区域和所述第二漏极区域配置所述第二非易失性存储器单元。
5.根据权利要求4所述的半导体器件,还包括:
第五绝缘膜,覆盖所述第三栅极电极的上表面,并且暴露所述第一栅极电极的上表面;
第六绝缘膜,覆盖所述第四栅极电极的上表面,并且暴露所述第二栅极电极的上表面。
6.根据权利要求1所述的半导体器件,
其中所述第一金属膜覆盖所述第一绝缘膜的侧表面,并且
其中所述第二金属膜覆盖所述第二绝缘膜的侧表面。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的