[发明专利]一种移位寄存器单元及其驱动方法、栅极驱动电路在审
申请号: | 201910506211.5 | 申请日: | 2019-06-12 |
公开(公告)号: | CN110070822A | 公开(公告)日: | 2019-07-30 |
发明(设计)人: | 谢勇贤;王慧;刘强;吕凤珍 | 申请(专利权)人: | 京东方科技集团股份有限公司;合肥鑫晟光电科技有限公司 |
主分类号: | G09G3/20 | 分类号: | G09G3/20;G11C19/28 |
代理公司: | 北京银龙知识产权代理有限公司 11243 | 代理人: | 许静;胡影 |
地址: | 100015 *** | 国省代码: | 北京;11 |
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摘要: | |||
搜索关键词: | 移位寄存器单元 栅极驱动电路 电平信号 输入端 耦接 栅极驱动信号输出端 控制子电路 上拉 断开 时钟信号输入端 栅极驱动信号 输出子电路 输入子电路 驱动 电路结构 时钟信号 输出时段 显示产品 窄边框化 阵列基板 晶体管 子电路 存储 占用 | ||
1.一种移位寄存器单元,其特征在于,包括:
输入子电路,分别与输入信号端和上拉节点耦接,用于在所述输入信号端提供的输入信号的控制下,控制导通或断开所述输入信号端与所述上拉节点之间的耦接;
存储子电路,所述存储子电路的一端与所述上拉节点耦接,所述存储子电路的另一端与栅极驱动信号输出端耦接;
输出子电路,分别与所述上拉节点、所述栅极驱动信号输出端和第一时钟信号输入端耦接,用于在所述上拉节点的电位的控制下,控制导通或断开所述栅极驱动信号输出端与所述第一时钟信号输入端之间的耦接;
控制子电路,分别与所述上拉节点、栅极驱动信号输出端、第一电平信号输入端和第二时钟信号输入端耦接,用于在输入时段和输出时段,在所述第二时钟信号输入端提供的第二时钟信号的控制下,控制断开所述上拉节点与所述第一电平信号输入端之间的耦接,以及控制断开所述栅极驱动信号输出端与所述第一电平信号输入端之间的耦接。
2.根据权利要求1所述的移位寄存器单元,其特征在于,所述控制子电路包括第一晶体管和第二晶体管;其中,
所述第一晶体管的栅极与所述第二时钟信号输入端耦接,所述第一晶体管的第一极与所述上拉节点耦接,所述第一晶体管的第二极与所述第一电平信号输入端耦接;
所述第二晶体管的栅极与所述第二时钟信号输入端耦接,所述第二晶体管的第一极与所述栅极驱动信号输出端耦接,所述第二晶体管的第二极与所述第一电平信号输入端耦接。
3.根据权利要求2所述的移位寄存器单元,其特征在于,所述移位寄存器单元形成在基底上,所述第一晶体管的栅极层和所述第一晶体管的有源层在垂直于所述基底的方向上的重叠区域形成为第一沟道区域;所述第二晶体管的栅极层和所述第二晶体管的有源层在垂直于基底的方向上的重叠区域形成为第二沟道区域;所述第一沟道区域的面积和所述第二沟道区域的面积均大于阈值。
4.根据权利要求1~3中任一项所述的移位寄存器单元,其特征在于,所述移位寄存器单元还包括:
第一帧前降噪子电路,分别与所述上拉节点、所述第一电平信号输入端和帧前降噪控制端耦接,用于在所述帧前降噪控制端提供的帧前降噪控制信号的控制下,控制导通或断开所述上拉节点与所述第一电平信号输入端之间的耦接;
第二帧前降噪子电路,分别与所述栅极驱动信号输出端、所述第一电平信号输入端和所述帧前降噪控制端耦接,用于在所述帧前降噪控制信号的控制下,控制导通或断开所述栅极驱动信号输出端与所述第一电平信号输入端之间的耦接。
5.根据权利要求4所述的移位寄存器单元,其特征在于,
所述第一帧前降噪子电路包括第三晶体管,所述第三晶体管的栅极与所述帧前降噪控制端耦接,所述第三晶体管的第一极与所述上拉节点耦接,所述第三晶体管的第二极与所述第一电平信号输入端耦接;
所述第二帧前降噪子电路包括第四晶体管,所述第四晶体管的栅极与所述帧前降噪控制端耦接,所述第四晶体管的第一极与所述栅极驱动信号输出端耦接,所述第四晶体管的第二极与所述第一电平信号输入端耦接。
6.根据权利要求1~3中任一项所述的移位寄存器单元,其特征在于,所述移位寄存器单元还包括:
第一复位子电路,分别与所述上拉节点、所述第一电平信号输入端和复位控制端耦接,用于在所述复位控制端提供的复位控制信号的控制下,控制导通或断开所述上拉节点与所述第一电平信号输入端之间的耦接;
第二复位子电路,分别与所述栅极驱动信号输出端、所述第一电平信号输入端和所述复位控制端耦接,用于在所述复位控制信号的控制下,控制导通或断开所述栅极驱动信号输出端与所述第一电平信号输入端之间的耦接。
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