[发明专利]一种3D NAND存储器及其制备方法在审
申请号: | 201910640261.2 | 申请日: | 2019-07-16 |
公开(公告)号: | CN110299362A | 公开(公告)日: | 2019-10-01 |
发明(设计)人: | 殷华湘;侯朝昭;李春龙 | 申请(专利权)人: | 中国科学院微电子研究所 |
主分类号: | H01L27/11524 | 分类号: | H01L27/11524;H01L27/11551 |
代理公司: | 北京知迪知识产权代理有限公司 11628 | 代理人: | 王胜利 |
地址: | 100029 *** | 国省代码: | 北京;11 |
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摘要: | |||
搜索关键词: | 层间介质层 控制栅极层 层叠结构 沟道层 衬底 沟道 制备 半导体存储器 层叠设置 常规工艺 垂直的 多晶 填充 存储 贯穿 | ||
1.一种3D NAND存储器,其特征在于,包括:
衬底;
设置于所述衬底上的层叠结构;沿所述衬底的厚度方向,所述层叠结构包括交替且层叠设置的多个控制栅极层和多个层间介质层,每个所述控制栅极层位于相邻两个所述层间介质层之间;所述层叠结构包括贯穿所述多个控制栅极层和所述多个层间介质层的沟道孔;
所述沟道孔中填充有沟道层,所述沟道层的材料包括多晶Si1-xGex。
2.根据权利要求1所述的3D NAND存储器,其特征在于,0.1<x<0.9,多晶Si1-xGex的晶粒直径范围为3nm~300nm,薄膜厚度3nm~500nm。
3.根据权利要求1或2所述的3D NAND存储器,其特征在于,所述沟道孔中还填充有侧壁堆叠结构;
在一个沟道孔中,沿所述沟道孔的一个侧壁指向与其相对的侧壁的方向,所述侧壁堆叠结构包括依次层叠设置的阻挡层、电荷俘获层、以及遂穿层;
所述阻挡层、所述电荷俘获层、以及所述遂穿层均位于所述沟道孔的侧壁与所述沟道层之间。
4.根据权利要求3所述的3D NAND存储器,其特征在于,所述阻挡层和所述遂穿层的材料包括氧化绝缘材料,所述电荷俘获层的材料包括氮化绝缘材料。
5.根据权利要求1或2所述的3D NAND存储器,其特征在于,所述沟道孔中还填充有保护层;
所述保护层位于所述沟道层背离其所在的所述沟道孔的侧壁一侧。
6.根据权利要求1或2所述的3D NAND存储器,其特征在于,还包括包围所述控制栅极层的氧化物阻挡层。
7.一种3D NAND存储器的制备方法,其特征在于,包括:
在衬底上依次形成层叠且交替设置的多个层间介质薄膜和多个牺牲层,每个所述层间介质薄膜位于相邻两个所述牺牲层之间;
形成贯穿所述多个层间介质薄膜和所述多个牺牲层的沟道孔,以得到层间介质层;
向所述沟道孔中填充沟道层,所述沟道层的材料包括多晶Si1-xGex。
8.根据权利要求7所述的3D NAND存储器的制备方法,其特征在于,0.1<x<0.9,多晶Si1-xGex的晶粒直径范围为3nm~300nm,薄膜厚度3nm~500nm。
9.根据权利要求7或8所述的3D NAND存储器的制备方法,其特征在于,在形成所述沟道孔之后、形成所述沟道层之前,所述3D NAND存储器的制备方法还包括:
在所述沟道孔中填充侧壁堆叠结构;在一个沟道孔中,沿所述沟道孔的一个侧壁指向与其相对的侧壁的方向,所述侧壁堆叠结构包括依次层叠设置的阻挡层、电荷俘获层、以及遂穿层。
10.根据权利要求9所述的3D NAND存储器的制备方法,其特征在于,所述阻挡层和所述遂穿层的材料包括氧化绝缘材料,所述电荷俘获层的材料包括氮化绝缘材料。
11.根据权利要求7或8所述的3D NAND存储器的制备方法,其特征在于,在形成所述沟道层之后,所述3D NAND存储器的制备方法还包括:
在所述沟道孔中形成保护层。
12.根据权利要求7或8所述的3D NAND存储器的制备方法,其特征在于,在形成所述沟道层之后,所述3D NAND存储器的制备方法还包括:
去除所述牺牲层,在相邻两个所述层间介质层之间形成镂空部;
在所述镂空部中依次形成氧化物阻挡层、控制栅极层,所述氧化物阻挡层包围所述控制栅极层。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
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H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的