[发明专利]一种开放式驱控一体化二次开发平台与系统在审
| 申请号： | 201910758040.5 | 申请日： | 2019-08-16 |
| 公开（公告）号： | CN110488698A | 公开（公告）日： | 2019-11-22 |
| 发明（设计）人： | 熊清平;周盈;许烈;关山;刘椿 | 申请（专利权）人： | 深圳华数机器人有限公司 |
| 主分类号： | G05B19/042 | 分类号： | G05B19/042 |
| 代理公司： | 44297 深圳市金笔知识产权代理事务所(特殊普通合伙) | 代理人： | 胡清方;彭友华<国际申请>=<国际公布> |
| 地址： | 518000 广东省深圳市南山区*** | 国省代码： | 广东;44 |
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| 摘要： | |||
| 搜索关键词： | 编程系统 电性连接 输出端 输入端 传感器接口 参数接收模块 内部功能模块 拓展 二次开发平台 芯片 指令代码 一体化 传输 | ||
1.一种开放式驱控一体化二次开发平台与系统，包括编程系统、FPGA系统以及PMSM组成，其特征在于：所述编程系统采用Linux系统，所述FPGA系统内部包括：功能模块、传感器接口、拓展IO、参数接收模块和FOC组成，所述编程系统的输出端与core1芯片的输入端电性连接，所述core1芯片的输出端与FPGA系统内部的参数接收模块的输入端电性连接，所述编程系统的输出端与FPGA系统内部功能模块、传感器接口以及拓展IO的输入端电性连接，所述FPGA系统内部功能模块、传感器接口以及拓展IO的输出端与编程系统的输入端电性连接，所述FPGA系统内部FOC的输出端与PMSM的输入端电性连接。
2.根据权利要求1所述的一种开放式驱控一体化二次开发平台与系统，其特征在于：所述编程系统所在的主控板上设置有core0芯片，所述core0芯片采用单芯多核异构SoC芯片。
3.根据权利要求1所述的一种开放式驱控一体化二次开发平台与系统，其特征在于：所述core1芯片采用单芯多核异构SoC芯片。
4.根据权利要求1所述的一种开放式驱控一体化二次开发平台与系统，其特征在于：所述FPGA系统为基于FPGA开发的包含PMSM的集成模块；其中，FPGA芯片采集编码器信息和电流反馈信息，通过反射内存卡与控制器交互控制信息，并通过数字模拟IO给出控制信号到功率驱动电路，控制PMSM的运行，所述FPGA系统所在的主控板上设置有接口管理、IPM接口和隔离模块。
5.根据权利要求1所述的一种开放式驱控一体化二次开发平台与系统，其特征在于：所述参数接收模块调用基础数据库中的参数接收配置信息，从IPM接口建立连接并接收传输数据帧，同时也接收core1接收处理后的信息。
6.根据权利要求1所述的一种开放式驱控一体化二次开发平台与系统，其特征在于：所述FPGA系统为一个或多个与被控PMSM相连的FPGA系统。
7.根据权利要求1所述的一种开放式驱控一体化二次开发平台与系统，其特征在于：所述拓展IO将来自Linux系统的指令通过数字模拟IO给出模拟数据信息传输到FPGA系统中，同时FPGA系统反馈的信息也通过数字模拟IO给出模拟数据信息传输到Linux系统中。
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