[发明专利]阵列基板的制造方法、阵列基板及显示面板在审
申请号: | 201911013537.0 | 申请日: | 2019-10-23 |
公开(公告)号: | CN110729237A | 公开(公告)日: | 2020-01-24 |
发明(设计)人: | 刘翔 | 申请(专利权)人: | 成都中电熊猫显示科技有限公司 |
主分类号: | H01L21/77 | 分类号: | H01L21/77;H01L27/12 |
代理公司: | 11205 北京同立钧成知识产权代理有限公司 | 代理人: | 黄溪;刘芳 |
地址: | 610200 四川省成*** | 国省代码: | 四川;51 |
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摘要: | |||
搜索关键词: | 金属氧化物半导体 半导体图形 低温多晶硅 阵列基板 金属氧化物保护层 显示面板 漏极 源极 沉积金属氧化物 沉积栅极绝缘层 栅极金属层 衬底基板 光刻工艺 图形连接 保护层 功耗 制造 | ||
1.一种阵列基板的制造方法,其特征在于,包括:
在衬底基板上间隔形成金属氧化物半导体图形和低温多晶硅半导体图形,其中,所述金属氧化物半导体图形位于与阵列基板的显示区域对应的区域内;
在所述金属氧化物半导体图形和低温多晶硅半导体图形上依次沉积栅极绝缘层和栅极金属层,并进行光刻工艺,以在所述金属氧化物半导体图形的上方形成第一栅极,在所述低温多晶硅半导体图形的上方形成第二栅极;
在所述第一栅极和第二栅极上沉积金属氧化物保护层,在金属氧化物保护层上形成与所述金属氧化物半导体图形连接的第一源极和第一漏极,并在所述金属氧化物保护层上形成与所述低温多晶硅半导体图形连接的第二源极和第二漏极。
2.根据权利要求1所述的阵列基板的制造方法,其特征在于,所述在衬底基板上间隔形成金属氧化物半导体图形和低温多晶硅半导体图形,具体包括:
在形成有金属氧化物半导体图形的衬底基板上沉积非晶硅膜;
利用退火工艺将所述非晶硅膜形成为多晶硅膜,并通过光刻工艺形成所述低温多晶硅半导体图形。
3.根据权利要求1所述的阵列基板的制造方法,其特征在于,所述在衬底基板上间隔形成金属氧化物半导体图形和低温多晶硅半导体图形,具体包括:
在形成有金属氧化物半导体图形的衬底基板上沉积氧化硅膜,并在所述氧化硅膜上沉积非晶硅膜;
利用退火工艺将所述非晶硅膜形成为多晶硅膜,并通过光刻工艺形成所述低温多晶硅半导体图形。
4.根据权利要求1-3任一项所述的阵列基板的制造方法,其特征在于,所述在衬底基板上间隔形成金属氧化物半导体图形和低温多晶硅半导体图形之前还包括:
在玻璃基板上形成遮光层,并在所述遮光层上沉积至少一层缓冲层,以形成所述衬底基板。
5.根据权利要求4所述的阵列基板的制造方法,其特征在于,最靠近所述金属氧化物半导体图形的第一缓冲层为氧化硅层,和/或,在形成所述第一缓冲层后,对所述第一缓冲层进行退火工艺。
6.根据权利要求1或2所述的阵列基板的制造方法,其特征在于,所述在所述金属氧化物保护层上形成第一漏极、第一源极、第二漏极、第二源极之后还包括:
在所述第一漏极、第一源极、第二漏极、第二源极上沉积钝化层,并通过光刻工艺在所述钝化层上位于所述第一漏极上方的区域形成导电过孔;
在形成有导电过孔的钝化层上沉积透明导电层,并通过光刻工艺形成像素电极,并使所述像素电极经由所述导电过孔和所述第一漏极电连接。
7.根据权利要求1或2所述的阵列基板的制造方法,其特征在于,
所述低温多晶硅半导体图形位于与阵列基板的非显示区域对应的区域内。
8.一种阵列基板,其特征在于,采用如权利要求1-7任一项所述的制造方法制造而成。
9.一种显示面板,其特征在于,包括权利要求8所述的阵列基板。
10.根据权利要求9所述的显示面板,其特征在于,所述显示面板为液晶显示面板或者为有机发光二极管显示面板。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造