[发明专利]一种基于CPLD/FPGA的复位控制方法、设备以及存储介质在审

专利信息
申请号: 201911022221.8 申请日: 2019-10-25
公开(公告)号: CN110764600A 公开(公告)日: 2020-02-07
发明(设计)人: 季冬冬;周延龙;张广乐 申请(专利权)人: 苏州浪潮智能科技有限公司
主分类号: G06F1/24 分类号: G06F1/24
代理公司: 11278 北京连和连知识产权代理有限公司 代理人: 刘小峰
地址: 215100 江苏省苏州市吴*** 国省代码: 江苏;32
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摘要:
搜索关键词: 使能信号 初始复位信号 复位电平 复位信号 主控设备 发送 可读存储介质 计算机设备 设计复杂度 复位控制 输出复位 信息生成 预设 响应 恢复
【权利要求书】:

1.一种基于CPLD/FPGA的复位控制方法,包括步骤:

接收初始复位信号和初始使能信号;

判断所述初始使能信号是否有效;

响应于所述初始使能信号有效,利用所述初始复位信号将CPLD的默认电平变为复位电平;

根据预设的复位信号信息生成并发送复位信号;

将所述复位电平恢复到默认电平。

2.如权利要求1所述的方法,其特征在于,判断所述初始使能信号是否有效,进一步包括:

利用第一模块判断所述初始使能信号是否有效。

3.如权利要求2所述的方法,其特征在于,利用所述初始复位信号将默认电平变为复位电平,进一步包括:

利用所述初始复位信号将所述第一模块中的复位电平由默认电平改为复位电平;

所述第一模块向第二模块发送所述复位电平以及使能信号。

4.如权利要求3所述的方法,其特征在于,根据预设的复位信号信息生成并发送复位信号,进一步包括:

第二模块响应于接收到所述复位电平,利用预设的复位信号信息生成并发送复位信号。

5.如权利要求4所述的方法,其特征在于,根据预设的复位信号信息生成复位信号,进一步包括:

根据预设的时间长度生成低电平脉冲信号。

6.如权利要求5所述的方法,其特征在于,根据预设的时间长度生成低电平脉冲信号,进一步包括:

利用计数器判断所述低电平脉冲信号的时间长度是否达到所述预设的时间长度;

响应于达到所述预设的时间长度,拉高输出电平以得到满足预设的时间长度的低电平脉冲信号。

7.如权利要求6所述的方法,其特征在于,将所述复位电平恢复到默认电平,进一步包括:

响应于拉高输出电平,所述第二模块向所述第一模块发送恢复默认电平信号;

所述第一模块根据所述恢复默认电平信号将所述复位电平恢复到默认电平。

8.如权利要求1所述的方法,其特征在于,还包括:

响应于所述初始使能信号无效,透传所述初始复位信号至外围设备。

9.一种计算机设备,包括:

至少一个处理器;以及

存储器,所述存储器存储有可在所述处理器上运行的计算机程序,其特征在于,所述处理器执行所述程序时执行如权利要求1-8任意一项所述的方法的步骤。

10.一种计算机可读存储介质,所述计算机可读存储介质存储有计算机程序,其特征在于,所述计算机程序被处理器执行时执行权利要求1-8任意一项所述的方法的步骤。

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