[实用新型]一种CPU管理扣卡有效
申请号: | 201920661993.5 | 申请日: | 2019-05-08 |
公开(公告)号: | CN210091015U | 公开(公告)日: | 2020-02-18 |
发明(设计)人: | 吴帅;李岩 | 申请(专利权)人: | 苏州浪潮智能科技有限公司 |
主分类号: | G06F1/16 | 分类号: | G06F1/16;G06F1/18;G06F1/26 |
代理公司: | 济南诚智商标专利事务所有限公司 37105 | 代理人: | 王汝银 |
地址: | 215100 江苏省苏州市吴*** | 国省代码: | 江苏;32 |
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摘要: | |||
搜索关键词: | 一种 cpu 管理 | ||
1.一种CPU管理扣卡,其特征在于,所述CPU管理扣卡包括:
用于完成系统上电、系统监控以及逻辑运算的CPU;
与所述CPU连接且用于减小CPU管理扣卡的内存模块;
通过若干个第一信号总线与所述CPU连接且控制所述CPU管理扣卡的上电时序以及与外部设备进行数据交互的第一复杂可编程逻辑器件;
与所述CPU连接的非易失性存储器;
与所述CPU连接且与外部设备进行通讯交互且为所述CPU管理扣卡提供供电电源的高速连接器;
其中,所述高速连接器还通过若干个第二信号线与所述第一复杂可编程逻辑器件连接。
2.根据权利要求1所述的CPU管理扣卡,其特征在于,所述内存模块包括第一小型双列直插式内存模块和第二小型双列直插式内存模块;
所述第一小型双列直插式内存模块和第二小型双列直插式内存模块分别与所述CPU连接。
3.根据权利要求2所述的CPU管理扣卡,其特征在于,用于连接所述CPU和所述高速连接器的第一信号线包括两组X8 PCIE3.0信号线,所述CPU通过两组X8 PCIE3.0信号线以及所述高速连接器与外部PCIE设备连接。
4.根据权利要求3所述的CPU管理扣卡,其特征在于,所述PCIE设备包括与所述高速连接器连接的网卡、显卡以及第二复杂可编程逻辑器件。
5.根据权利要求3所述的CPU管理扣卡,其特征在于,所述第一信号线包括两组I2C信号线,所述I2C信号线通过所述高速连接器与用于获取系统关键点的温度以及关键电压的外接温度传感器连接。
6.根据权利要求3所述的CPU管理扣卡,其特征在于,所述第一信号线包括四组用于通过所述高速连接器连接外部光口的LAN信号线。
7.根据权利要求3所述的CPU管理扣卡,其特征在于,所述第一信号线包括两组用于连接外接设备的USB2.0信号线,所述外接设备包括外接鼠标、键盘以及U盘。
8.根据权利要求3所述的CPU管理扣卡,其特征在于,所述第二信号线包括GPIO信号线和IRQ信号线。
9.根据权利要求3所述的CPU管理扣卡,其特征在于,所述CPU与所述第一复杂可编程逻辑器件之间通过I2C信号线连接。
10.根据权利要求1至9任一项所述的CPU管理扣卡,其特征在于,所述CPU管理扣卡还包括与所述CPU通过SPI总线连接的第一BIOS和第二BIOS。
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