[实用新型]存储结构有效
申请号: | 201920832133.3 | 申请日: | 2019-06-04 |
公开(公告)号: | CN210272356U | 公开(公告)日: | 2020-04-07 |
发明(设计)人: | 不公告发明人 | 申请(专利权)人: | 长鑫存储技术有限公司 |
主分类号: | H01L27/108 | 分类号: | H01L27/108;H01L21/8242 |
代理公司: | 上海盈盛知识产权代理事务所(普通合伙) 31294 | 代理人: | 孙佳胤;高德志 |
地址: | 230001 安徽省合肥市蜀山*** | 国省代码: | 安徽;34 |
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摘要: | |||
搜索关键词: | 存储 结构 | ||
1.一种存储结构,其特征在于,包括:
半导体衬底,所述半导体衬底上形成有行列排布的若干分立的有源区,相邻有源区之间具有第一凹槽,所述第一凹槽包括沿列方向排布的若干第一沟槽以及沿行方向排布的若干第二沟槽,所述第一沟槽中填充满绝缘层,所述第二沟槽中填充有第一抗刻蚀介电层;
位于所述相邻第一抗刻蚀介电层之间的有源区的侧壁表面和绝缘层中的第二抗刻蚀介电层;
位于每个有源区中的沿行方向分布的两个第二凹槽,所述两个第二凹槽将每个有源区分成位于中间的漏极和分别位于漏极两侧的两个源极,且所述两个第二凹槽分别位于第二抗刻蚀介电层两侧,所述绝缘层的表面低于第二凹槽的底部表面;
位于第一抗刻蚀介电层和第二抗刻蚀介电层之间的绝缘层上的第三凹槽,所述第三凹槽至少暴露出第二凹槽底部的有源区两侧侧壁的部分表面以及第二凹槽两侧的源极和漏极侧壁的部分表面,所述第三凹槽与相应的第二凹槽连通;
位于所述第二凹槽和第三凹槽中栅极结构。
2.如权利要求1所述的存储结构,其特征在于,所述第一抗刻蚀介电层和第二抗刻蚀介电层的材料与绝缘层的材料不相同。
3.如权利要求2所述的存储结构,其特征在于,所述第一抗刻蚀介电层和第二抗刻蚀介电层的深度大于第三凹槽和第二凹槽的总深度。
4.如权利要求2所述的存储结构,其特征在于,所述第二沟槽底部的长条形主动区和绝缘层中具有第三沟槽,所述第三沟槽沿行方向上的尺寸大于第二沟槽沿行方向上的尺寸;所述第三沟槽底部的长条形主动区和绝缘层中具有第四沟槽,第一抗刻蚀介电层位于所述第四沟槽、第三沟槽和第二沟槽中。
5.如权利要求4所述的存储结构,其特征在于,所述第三凹槽不仅暴露出第二凹槽底部的有源区两侧侧壁的部分表面以及第二凹槽两侧的源极和漏极侧壁的部分表面,所述第三凹槽还暴露出第二沟槽或者第三沟槽的部分侧壁表面,或者有源区的远离第二凹槽一侧侧壁的部分表面。
6.如权利要求2所述的存储结构,其特征在于,所述第三凹槽仅暴露出第二凹槽底部的有源区两侧侧壁的部分表面以及第二凹槽两侧的源极和漏极侧壁的部分表面。
7.如权利要求2所述的存储结构,其特征在于,所述栅极结构包括:位于所述第二凹槽和第三凹槽侧壁表面的栅介质层;位于所述栅介质层上且填充满第二凹槽和第三凹槽的栅极。
8.如权利要求7所述的存储结构,其特征在于,还包括:与栅极连接的位线;位于所述绝缘层上且与源极连接的电容器;位于所述绝缘层上且与漏极连接的位线。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的