[发明专利]并行处理设备有效
申请号: | 201980030190.2 | 申请日: | 2019-05-20 |
公开(公告)号: | CN112074810B | 公开(公告)日: | 2023-07-21 |
发明(设计)人: | 金泰亨 | 申请(专利权)人: | 莫鲁米有限公司 |
主分类号: | G06F9/38 | 分类号: | G06F9/38 |
代理公司: | 北京博思佳知识产权代理有限公司 11415 | 代理人: | 艾佳 |
地址: | 韩国*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 并行 处理 设备 | ||
1.一种允许执行连续并行数据处理的并行处理设备,所述并行处理设备包括:
计算路径网络,被配置为接收从延迟处理单元输出的多个延迟数据、从存储器输出的多个存储器输出数据、以及多个计算路径网络控制信号,并被配置为输出多个计算路径网络输出数据;以及
延迟处理单元,被配置为输出通过延迟所述多个计算路径网络输出数据而获得的所述多个延迟数据,
其中,所述多个计算路径网络输出数据中的每个计算路径网络输出数据为通过对所述多个延迟数据和所述多个存储器输出数据执行计算而获得的值,所述值对应于所述多个计算路径网络控制信号之中与该计算路径网络输出数据相对应的计算路径网络控制信号。
2.根据权利要求1所述的并行处理设备,其中,所述延迟处理单元根据时钟来延迟所述多个计算路径网络输出数据。
3.根据权利要求2所述的并行处理设备,其中,在单个时钟周期中,所述计算路径网络接收所述多个延迟数据和所述多个存储器输出数据,并输出与所接收的所述多个延迟数据和所接收的所述多个存储器输出数据相对应的所述多个计算路径网络输出数据。
4.根据权利要求1所述的并行处理设备,其中,所述计算路径网络包括多个主处理单元,
所述多个主处理单元之中的第一主处理单元通过对所述多个延迟数据和所述多个存储器输出数据执行与所述多个计算路径网络控制信号之中的第一计算路径网络控制信号相对应的第一计算,输出所述多个计算路径网络输出数据之中的与所述第一主处理单元相对应的第一计算路径网络输出数据,以及
所述多个主处理单元之中的第二主处理单元通过对所述多个延迟数据和所述多个存储器输出数据执行与所述多个计算路径网络控制信号之中的第二计算路径网络控制信号相对应的第二计算,输出所述多个计算路径网络输出数据之中的与所述第二主处理单元相对应的第二计算路径网络输出数据。
5.根据权利要求1所述的并行处理设备,其中,所述计算路径网络包括:
多个多路复用器,被配置为接收所述多个延迟数据和所述多个存储器输出数据,并输出多个多路复用器输出数据;以及
多个主处理单元,被配置为接收所述多个多路复用器输出数据,并输出所述多个计算路径网络输出数据,
所述多个多路复用器中的每个多路复用器通过选择所述多个延迟数据之中与该多路复用器相对应的延迟数据和所述多个存储器输出数据之中与该多路复用器相对应的存储器输出数据中的任何一个,来获得与所述多个多路复用器之中的该多路复用器相对应的多路复用器输出数据,
所述多个主处理单元之中的第一主处理单元通过对所述多个多路复用器输出数据执行与所述多个计算路径网络控制信号之中的第一计算路径网络控制信号相对应的第一计算,输出所述多个计算路径网络输出数据之中的与所述第一主处理单元相对应的第一计算路径网络输出数据,以及
所述多个主处理单元之中的第二主处理单元通过对所述多个多路复用器输出数据执行与所述多个计算路径网络控制信号之中的第二计算路径网络控制信号相对应的第二计算,输出所述多个计算路径网络输出数据之中的与所述第二主处理单元相对应的第二计算路径网络输出数据。
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