[发明专利]通过并行前缀计算的优化的包容亚稳态的排序在审
申请号: | 201980072321.3 | 申请日: | 2019-10-31 |
公开(公告)号: | CN112969998A | 公开(公告)日: | 2021-06-15 |
发明(设计)人: | C·伦曾 | 申请(专利权)人: | 马克斯·普朗克科学促进学会 |
主分类号: | G06F7/24 | 分类号: | G06F7/24 |
代理公司: | 中国贸促会专利商标事务所有限公司 11038 | 代理人: | 於菪珉 |
地址: | 德国*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 通过 并行 前缀 计算 优化 包容 亚稳态 排序 | ||
1.一种排序电路,其特征在于,所述电路是包容亚稳态的。
2.如权利要求1所述的电路,所述电路包括用于比较至少两个输入串的每个前缀对的一个或多个子电路。
3.如权利要求2所述的电路,所述电路还包括用于基于比较的结果来推断输出位的子电路。
4.如权利要求2所述的电路,其中,输入串是格雷编码的。
5.如权利要求3所述的电路,其中,格雷码是二进制反射格雷码。
6.如前述权利要求中一项所述的电路,其中,所述排序电路是用于对两个输入串排序的2-排序电路。
7.如前述权利要求中一项所述的电路,其中,所述排序电路是用于对n个串排序的排序网络。
8.如前述权利要求中一项所述的电路,其中,所述排序电路的大小在输入串的大小O(B)的量级内。
9.如前述权利要求中一项所述的电路,其中,缓冲器被用于限制扇出。
10.如权利要求9所述的电路,其中,所使用的缓冲器的数量是输入串的长度(B)的两倍。
11.如权利要求9或10所述的电路,其中,所述排序电路的扇出是恒定的。
12.如前述权利要求中一项所述的电路,其中,所述排序电路的深度在的量级内,其中,B是输入串中的位的数量。
13.一种晶体管级实施,所述晶体管级实施根据前述权利要求所述的电路中的一个电路。
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