[发明专利]用于提供多级纠错的技术在审
申请号: | 202010143019.7 | 申请日: | 2020-03-04 |
公开(公告)号: | CN111796964A | 公开(公告)日: | 2020-10-20 |
发明(设计)人: | 吴微;R.孙达拉姆;C.乔汉;J.B.坎;冨嶋茂樹;S.斯里尼瓦桑 | 申请(专利权)人: | 英特尔公司 |
主分类号: | G06F11/10 | 分类号: | G06F11/10 |
代理公司: | 中国专利代理(香港)有限公司 72001 | 代理人: | 李啸;姜冰 |
地址: | 美国加利*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 用于 提供 多级 纠错 技术 | ||
用于提供多级纠错的技术包括一种存储器,该存储器包括耦合到存储器介质的介质访问电路。介质访问电路要从存储器介质读取数据。另外,介质访问电路要利用位于介质访问电路中的纠错逻辑单元对读取的数据执行纠错以产生经纠错的数据。
背景技术
确保数据的可靠性对于存储器和存储装置是重大的挑战。典型的方法是要用存储器控制器执行纠错码(ECC)过程,其涉及用冗余位(例如,在写入过程期间)编码数据集并且(例如,在读取过程期间)解码数据集,同时使用冗余位来检测和纠正数据集中的错误。存储器控制器然后可以将经纠错的数据提供给处理器或其它组件(例如,加速器装置)以对经纠错的数据执行操作。为了减轻由冗余位引起的开销,要保护以免损坏的每个数据集的大小往往相对较大,例如两千位或四千位。然而,上述方案对于可以在存储器中(例如,在存储器管芯上,而不是由计算装置的处理器或其它组件)对数据执行计算的架构呈现低效率。更特别地,将数据(例如,通过总线)从数据驻留在其上的存储器介质发送到存储器控制器以执行纠错过程以及然后通过总线将经纠错的数据从存储器控制器发送回的动作消耗能量和时间,并且可能降低任何效率(在其它方式中将通过在存储器中执行计算获得所述效率)。
附图说明
在附图中通过示例的方式而非通过限制的方式图示了本文中描述的概念。为了说明的简单和清楚,附图中图示的元件不一定按比例绘制。在认为适当的地方,在附图之中已经重复参考标记以指示对应或类似的元件。
图1是用于提供对数据的多级纠错的计算装置的至少一个实施例的简化图;
图2是包括在图1的计算装置中的存储器介质的至少一个实施例的简化图;
图3是包括在图1的计算装置中的存储器的介质访问电路的组件和存储器介质的分区的至少一个实施例的简化图;
图4是可以在图1的计算装置的存储器中执行的张量运算的至少一个实施例的简化图;
图5-7是可以由图1的计算装置执行的用于提供多级纠错的方法的至少一个实施例的简化图。
具体实施方式
虽然本公开的概念易受各种修改和备选形式影响,但是其特定实施例已经在附图中通过示例的方式示出并且将在本文中详细描述。然而,应当理解,不旨在将本公开的概念限制成所公开的特定形式,而是相反,意图是要涵盖与本公开和所附权利要求一致的所有修改、等同物和备选。
说明书中对“一个实施例”、“实施例”、“说明性实施例”等的引用指示所描述的实施例可以包括特定特征、结构或特性,但是每个实施例可能或可能不一定包括特定特征、结构或特性。此外,这样的短语不一定指的是相同的实施例。此外,当结合实施例描述特定特征、结构或特性时,认为结合其它实施例实现这样的特征、结构或特性在本领域技术人员的知识范围内,而不管是否明确描述所述其它实施例。另外,应当领会,采用“至少一个A、B和C”的形式的列表中包括的项目能够意味着(A);(B);(C);(A和B);(A和C);(B和C);或(A、B和C)。类似地,采用“A、B或C中的至少一个”的形式列出的项目能够意味着(A);(B);(C);(A和B);(A和C);(B和C);或(A、B和C)。
在一些情况下,所公开的实施例可以采用硬件、固件、软件或其任意组合来实现。所公开的实施例还可以被实现为由暂时性或非暂时性机器可读(例如,计算机可读)存储介质承载或存储在其上的指令,所述指令可以由一个或多个处理器读取和执行。机器可读存储介质可以被体现为用于采用由机器可读的形式存储或传送信息的任何存储装置、机构或其它物理结构(例如,易失性或非易失性存储器、介质盘或其它介质装置)。
在附图中,一些结构或方法特征可以采用特定布置和/或排序示出。然而,应当领会,可能不要求这样的特定布置和/或排序。而是,在一些实施例中,这样的特征可以采用与说明性附图中示出的不同的方式和/或顺序来布置。另外,在特定附图中包括结构或方法特征不打算意味着在所有实施例中要求这样的特征,并且在一些实施例中,可不包括这样的特征或者这样的特征可与其它特征组合。
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