[发明专利]一种高耐压的n沟道LDMOS器件及其制备方法有效

专利信息
申请号: 202010179995.8 申请日: 2020-03-16
公开(公告)号: CN113410299B 公开(公告)日: 2023-01-31
发明(设计)人: 罗谦;文厚东;姜玄青;范镇 申请(专利权)人: 电子科技大学
主分类号: H01L29/78 分类号: H01L29/78;H01L29/06;H01L21/336
代理公司: 成都点睛专利代理事务所(普通合伙) 51232 代理人: 霍淑利
地址: 611731 四川省成*** 国省代码: 四川;51
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摘要:
搜索关键词: 一种 耐压 沟道 ldmos 器件 及其 制备 方法
【权利要求书】:

1.一种高耐压的n沟道LDMOS器件,包括半导体衬底(1)、n型轻掺杂漂移区(2)、p型阱区(3)、栅极结构、n型重掺杂源极(6)和n型重掺杂漏极(7);

p型阱区(3)位于所述半导体衬底(1)的顶层一侧,n型轻掺杂漂移区(2)位于所述半导体衬底(1)的顶层另一侧;n型重掺杂漏极(7)位于n型轻掺杂漂移区(2)的顶层远离p型阱区(3)的一侧,n型重掺杂源极(6)位于p型阱区(3)的顶层远离n型轻掺杂漂移区(2)的一侧;栅极结构位于p型阱区(3)上,且位于n型重掺杂源极(6)和n型轻掺杂漂移区(2)之间;

其特征在于,还包括多个沿栅漏方向延伸的梳指状p型半导体块(8)和多个电极(10),多个p型半导体块(8)位于n型轻掺杂漂移区(2)上,且位于栅极结构和n型重掺杂漏极(7)之间,多个p型半导体块(8)与栅极结构和n型重掺杂漏极(7)间隔设置;多个电极(10)位于多个p型半导体块(8)上靠近栅极结构的一侧,通过多个电极(10)将多个p型半导体块(8)与n型重掺杂源极(6)进行电学连接,使所述多个p型半导体块(8)与n型重掺杂源极(6)相互连通。

2.根据权利要求1所述的一种高耐压的n沟道LDMOS器件,其特征在于,所述多个p型半导体块(8)之间设置绝缘介质(9)。

3.根据权利要求2所述的一种高耐压的n沟道LDMOS器件,其特征在于,所述绝缘介质(9)向所述n型重掺杂漏极(7)方向延伸并填充所述p型半导体块(8)与所述n型重掺杂漏极(7)之间的间隙。

4.根据权利要求1所述的一种高耐压的n沟道LDMOS器件,其特征在于,所述栅极结构包括从下而上依次设置的栅氧化层(4)和栅极(5)。

5.根据权利要求1所述的一种高耐压的n沟道LDMOS器件,其特征在于,所述半导体衬底(1)的导电类型为n型或p型。

6.一种高耐压的n沟道LDMOS器件的制备方法,其特征在于,包括以下步骤:

步骤1、采用光刻工艺和离子注入工艺在半导体衬底(1)的顶层一侧形成p型阱区(3),在半导体衬底(1)的顶层另一侧形成n型轻掺杂漂移区(2);

步骤2、采用氧化和淀积工艺依次形成栅氧化层和多晶硅,然后扩磷掺杂,刻蚀后在p型阱区(3)靠近n型轻掺杂漂移区(2)的一侧上形成栅氧化层(4)和栅极(5);

步骤3、在p型阱区(3)的另一侧注入磷杂质,横向扩散后形成n型重掺杂源极(6);

步骤4、在n型轻掺杂漂移区(2)远离p型阱区(3)的一侧中注入磷杂质以形成n型重掺杂漏极(7);

步骤5、在n型轻掺杂漂移区(2)上方且在栅极(5)与n型重掺杂漏极(7)之间形成p型Si层,在p型Si层上靠近栅极(5)的一侧淀积电极;

步骤6、图形化刻蚀电极和p型Si层至n型轻掺杂漂移区(2)表面,在n型轻掺杂漂移区(2)上方形成多个均匀分布且沿着栅漏方向延伸的梳指状p型Si块和电极(10),通过多个电极(10)将多个p型Si块与n型重掺杂源极(6)进行电学连接,使所述多个p型Si块与n型重掺杂源极(6)相互连通。

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