[发明专利]存储器控制器和包括该存储器控制器的存储器系统在审
申请号: | 202010489243.1 | 申请日: | 2020-06-02 |
公开(公告)号: | CN112527549A | 公开(公告)日: | 2021-03-19 |
发明(设计)人: | 李起准;金赞起;赵诚慧;李明奎 | 申请(专利权)人: | 三星电子株式会社 |
主分类号: | G06F11/10 | 分类号: | G06F11/10;G06F11/30 |
代理公司: | 北京铭硕知识产权代理有限公司 11286 | 代理人: | 刘灿强;韩芳 |
地址: | 韩国京畿*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 存储器 控制器 包括 系统 | ||
1.一种被配置为控制存储器模块的存储器控制器,所述存储器控制器包括:
处理电路,被配置为:
使用奇偶校验矩阵的第一部分对来自存储器模块的读取码字执行纠错码解码,以生成第一校正子和第二校正子;
基于第二校正子和判定校正子来确定读取码字中的错误的类型,判定校正子与第一校正子和第二校正子之和对应;以及
输出指示错误的类型的解码状态标志。
2.根据权利要求1所述的存储器控制器,其中,处理电路被配置为:
响应于判定校正子具有非零逻辑电平,输出指示读取码字的用户数据集包括可纠正的错误的解码状态标志;
基于奇偶校验矩阵的第二部分和读取码字来生成指示可纠正的错误的位置的第三校正子;以及
使用第三校正子来纠正可纠正的错误以获得纠正的用户数据集。
3.根据权利要求1所述的存储器控制器,其中,处理电路被配置为:响应于判定校正子具有零逻辑电平并且第二校正子具有零逻辑电平,输出指示读取码字的用户数据集不包括错误的解码状态标志。
4.根据权利要求1所述的存储器控制器,其中,处理电路被配置为:响应于判定校正子具有零逻辑电平并且第二校正子具有非零逻辑电平,输出指示读取码字的用户数据集包括不可纠正的错误的解码状态标志。
5.根据权利要求1所述的存储器控制器,其中,读取码字包括用户数据集、与用户数据集相关联的元数据、错误定位奇偶校验数据、第一错误大小奇偶校验数据以及第二错误大小奇偶校验数据。
6.根据权利要求5所述的存储器控制器,其中:
存储器模块包括多个数据芯片、第一奇偶校验芯片和第二奇偶校验芯片;
用户数据集从所述多个数据芯片被读取;
元数据和错误定位奇偶校验数据从第一奇偶校验芯片被读取;以及
第一错误大小奇偶校验数据和第二错误大小奇偶校验数据从第二奇偶校验芯片被读取。
7.根据权利要求1所述的存储器控制器,其中,奇偶校验矩阵包括第一奇偶校验子矩阵、第二奇偶校验子矩阵和第三奇偶校验子矩阵。
8.根据权利要求7所述的存储器控制器,其中:
第二奇偶校验子矩阵包括多个单位子矩阵和多个第一零子矩阵,所述多个单位子矩阵和所述多个第一零子矩阵中的每个子矩阵具有p×p个元素,所述多个单位子矩阵和所述多个第一零子矩阵交替布置,并且p是大于1的自然数;
第三奇偶校验子矩阵包括多个第二零子矩阵和多个第一偏移子矩阵,所述多个第二零子矩阵和所述多个第一偏移子矩阵中的每个子矩阵具有p×p个元素,所述多个第二零子矩阵和所述多个第一偏移子矩阵交替布置;
第一奇偶校验子矩阵包括多个第二偏移子矩阵和两个第三零子矩阵,所述多个第二偏移子矩阵彼此不同并与包括在存储器模块中的多个数据芯片对应;并且
奇偶校验矩阵的第一部分包括第二奇偶校验子矩阵和第三奇偶校验子矩阵。
9.根据权利要求8所述的存储器控制器,其中,处理电路被配置为:
通过对读取码字和第二奇偶校验子矩阵执行矩阵乘法运算来生成第一校正子;
通过对读取码字和第三奇偶校验子矩阵执行矩阵乘法运算来生成第二校正子;以及
通过对第一校正子和第二校正子求和来生成判定校正子。
10.根据权利要求9所述的存储器控制器,其中,处理电路被配置为:响应于判定校正子具有非零逻辑电平,通过对读取码字和第一奇偶校验子矩阵执行矩阵乘法运算来生成指示可纠正的错误的位置的第三校正子。
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