[发明专利]一种跟随保持开关电路有效

专利信息
申请号: 202010795061.7 申请日: 2020-08-10
公开(公告)号: CN111900986B 公开(公告)日: 2022-08-16
发明(设计)人: 徐代果;付东兵;张正平;俞宙;王健安;朱璨;李儒章;陈光炳;王育新;徐学良 申请(专利权)人: 中国电子科技集团公司第二十四研究所;重庆吉芯科技有限公司
主分类号: H03M1/12 分类号: H03M1/12
代理公司: 上海光华专利事务所(普通合伙) 31219 代理人: 代玲
地址: 400060 *** 国省代码: 重庆;50
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摘要:
搜索关键词: 一种 跟随 保持 开关电路
【权利要求书】:

1.一种跟随保持开关电路,其特征在于,包括:

跟随器;

采样子电路,用于进行电压采样;所述采样子电路包括采样电容、第二MOS管、第四MOS管和第五MOS管;

自举控制子电路,用于在电路处于跟随状态时为所述采样子电路提供自举电压;所述自举控制子电路包括:第七MOS管、第八MOS管、第九MOS管、第十MOS管、第十一MOS管、第十二MOS管和自举模块;

采样开关控制子电路,用于在电路处于保持状态时,为所述自举控制子电路中的自举电容提供共模电压;所述采样开关控制子电路包括第三MOS管、第六MOS管、第十三MOS管;

所述跟随器与所述采样子电路的输出端连接;所述采样子电路通过采样开关分别连接所述自举控制子电路和所述采样开关控制子电路;通过时钟信号及其反相时钟信号控制整个电路的所述跟随状态和所述保持状态;

所述采样电容的一端分别连接所述跟随器的输入端和所述第五MOS管的漏极,另一端分别连接所述第二MOS管的漏极和第四MOS管的漏极;所述第二MOS管作为所述采样开关,所述第二MOS管的栅极与所述第十三MOS管的漏极连接,所述第二MOS管的源极分别连接所述第七MOS管的漏极、所述第八MOS管的源极、所述第三MOS管的漏极以及所述自举模块的一端;所述自举模块的另一端分别连接所述第十MOS管的源极、所述第十一MOS管的源极以及所述第十二MOS管的源极;所述第四MOS管的栅极接所述反相时钟信号,所述第五MOS管的栅极接所述时钟信号;所述第四MOS管的源极和所述第五MOS管的源极相连,并接入所述共模电压;所述第十三MOS管的栅极分别连接所述第六MOS管的栅极和所述第三MOS管的栅极,并连接所述反相时钟信号;所述第十三MOS管的源极、第三MOS管的源极、第六MOS管的源极相连并连接所述共模电压;所述第六MOS管的漏极与所述第七MOS管的栅极连接;所述第七MOS管的源极接输入电压;所述第七MOS管的栅极与所述第十一MOS管的漏极连接;所述第十二MOS管的漏极分别连接所述采样开关的栅极和所述第十三MOS管的漏极;所述第九MOS管的漏极分别连接所述第十一MOS管的栅极、所述第十二MOS管的栅极和所述第八MOS管的漏极;所述第九MOS管的栅极与所述第八MOS管的栅极连接,并连接所述时钟信号;所述第九MOS管的源极与所述第十MOS管的漏极连接,并接入电源电压;所述第十MOS管的栅极接入所述时钟信号。

2.根据权利要求1所述的跟随保持开关电路,其特征在于,包括:通过时钟信号及其反相时钟信号控制整个电路的所述跟随状态和所述保持状态。

3.根据权利要求2所述的跟随保持开关电路,其特征在于,当所述时钟信号为低电平且所述反相时钟信号为高电平时,电路处于保持状态;当所述时钟信号为高电平且所述反相时钟信号为低电平时,电路处于跟随状态。

4.根据权利要求1所述的跟随保持开关电路,其特征在于,所述跟随器至少包括第一MOS管和恒流源,所述第一MOS管的漏极接电源电压,栅极与所述采样子电路连接,源极与所述恒流源的正端连接;所述恒流源的负端接地。

5.根据权利要求1所述的跟随保持开关电路,其特征在于,所述自举模块采用一个自举电容,所述自举电容的一端与所述采样开关的源极连接,另一端与所述第十二MOS管的源极连接。

6.根据权利要求1所述的跟随保持开关电路,其特征在于,所述跟随器、采样子电路和所述采样开关控制子电路中的MOS管均采用NMOS管。

7.根据权利要求1所述的跟随保持开关电路,其特征在于,所述第七至第八MOS管均采用NMOS管;所述第九至第十二MOS管均采用PMOS管。

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