[发明专利]一种单电子记忆胞及其制造方法有效
申请号: | 202010985439.X | 申请日: | 2020-09-18 |
公开(公告)号: | CN112234065B | 公开(公告)日: | 2022-07-12 |
发明(设计)人: | 杨子庆 | 申请(专利权)人: | 苏州浪潮智能科技有限公司 |
主分类号: | H01L27/11517 | 分类号: | H01L27/11517;H01L27/11521 |
代理公司: | 北京权智天下知识产权代理事务所(普通合伙) 11638 | 代理人: | 王新爱 |
地址: | 215124 江苏省苏州*** | 国省代码: | 江苏;32 |
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摘要: | |||
搜索关键词: | 一种 电子 记忆 及其 制造 方法 | ||
1.一种单电子记忆胞,其特征在于,包括:单电子晶体管、金氧半场效晶体管和硅基底,单电子晶体管位于金氧半场效晶体管上方,硅基底上表面设有绝缘体;所述单电子晶体管包括字符线、纳米线、悬浮点、能量障壁和控制闸,字符线、纳米线、悬浮点、能力障壁和控制闸均位于硅基底上方绝缘体的同一平面上;所述金氧半场效晶体管包括源极、通道和汲极,通道位于悬浮点的正下面,通道与悬浮点之间有所述绝缘体。
2.根据权利要求1所述的一种单电子记忆胞,其特征在于:所述单电子晶体管的电源为字符线电压,所述字符线与控制闸各接于电源的两端。
3.根据权利要求2所述的一种单电子记忆胞,其特征在于:所述绝缘体材质为SiO2,绝缘体在硅基底上通过硅基底的氧化形成;所述字符线、纳米线、控制闸均为掺杂磷的多晶硅;所述悬浮点为是掺杂硼的多晶硅嵌入于能量障壁中而形成;能量障壁材质为SiO2。
4.根据权利要求3所述的一种单电子记忆胞,其特征在于:所述字符线为自由载子的供应者;所述纳米线是利于自由载子通过的一维度穿隧路线;所述悬浮点为自由载子的穿隧目标;所述能量障壁阻止自由载子的穿隧;所述控制闸利用与悬浮点之间的能量障壁厚度来控制是否有单电子晶体管电流。
5.根据权利要求4所述的一种单电子记忆胞,其特征在于:所述字符线中掺杂磷的浓度高于纳米线和控制闸中掺杂磷的浓度。
6.根据权利要求1所述的一种单电子记忆胞,其特征在于:所述金氧半场效晶体管的电源是汲极-源极电压。
7.根据权利要求6所述的一种单电子记忆胞,其特征在于:所述源极与汲极均是掺杂量比正常多的“N+”半导体,源极与汲极各接于电源的两端。
8.根据权利要求7所述的一种单电子记忆胞,其特征在于:所述通道为反转层,通道的感应电荷与穿隧进入悬浮点的电荷为相反特性。
9.根据以上任一权利要求所述的一种单电子记忆胞的制造方法,其特征在于,包括以下步骤:
S1,取用硅基底;
S2,在硅基底上表面进行氧化,形成原始SiO2绝缘层;
S3,对硅基底上表面的原始SiO2绝缘层进行蚀刻,蚀刻成指定尺寸的SiO2绝缘层;
S4,在步骤S3形成的SiO2绝缘层上沉积字符线的多晶硅;
S5,在步骤S3形成的SiO2绝缘层上沉积纳米线和悬浮点的多晶硅,纳米线位于字符线与悬浮点之间;
S6,首先在悬浮点的多晶硅侧面进行氧化,形成SiO2能量障壁,然后在步骤S3形成的SiO2绝缘层上沉积控制闸的多晶硅,控制闸的多晶硅紧贴SiO2能量障壁;
S7,对字符线的多晶硅掺杂浓度较高的磷,形成字符线;对纳米线的多晶硅掺杂正常浓度的潜入磷,形成纳米线;对悬浮点的多晶硅掺杂硼,掺杂硼后的多晶硅嵌入SiO2能量障壁形成悬浮点;对控制闸的多晶硅掺杂磷,形成控制闸;
S8,在硅基底上位于SiO2绝缘层下方进行离子布植,形成金氧半场效晶体管的源极和汲极,源极与汲极均为掺杂量比正常多的“N+”半导体;金氧半场效晶体管的通道位于悬浮点正下方SiO2绝缘层的下面。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的