[发明专利]FIFO存储器及FIFO存储器的处理方法在审
| 申请号： | 202011130749.X | 申请日： | 2020-10-21 |
| 公开（公告）号： | CN112286489A | 公开（公告）日： | 2021-01-29 |
| 发明（设计）人： | 项圣文;刘应 | 申请（专利权）人： | 深圳市紫光同创电子有限公司 |
| 主分类号： | G06F5/06 | 分类号： | G06F5/06;G06F1/24 |
| 代理公司： | 深圳国新南方知识产权代理有限公司 44374 | 代理人： | 周雷 |
| 地址： | 518000 广东省深圳市南山区粤海*** | 国省代码： | 广东;44 |
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| 摘要： | |||
| 搜索关键词： | fifo 存储器 处理 方法 | ||
本发明提供了一种FIFO存储器的处理方法，所述FIFO存储器包括数据缓存模块和地址控制模块；所述处理方法包括，所述地址控制模块接收所述数据缓存模块的空/满状态信号；所述地址控制模块调整所述数据缓存模块的读写地址差值。本发明当所述地址控制模块接收所述数据缓存模块的空/满状态信号，所述地址控制模块调整所述数据缓存模块的读写地址差值，从而避免指针碰撞导致FIFO存储器异常，保证数据正常通信。
【技术领域】
本发明涉及通信技术领域，尤其涉及一种FIFO存储器的处理方法。
【背景技术】
当前跨时钟域处理一般按照FIFO应用方法，其设定固定的FIFO深度、以及读写指针差值，当检测到FIFO异常状态后，需要通过复位操作，FIFO才能恢复正常。
上述复位操作存在如下不足：FIFO异常后，不能快速自动恢复正常，需要依靠软件等监测到FIFO异常状态后，进行复位操作才能恢复正常，由于软件等监测相对复杂，FIFO恢复所需的时间比较长，进而影响链路正常通信。
【发明内容】
本发明的目的在于提供了一种FIFO存储器的处理方法，当FIFO异常时，能够自动恢复正常。
为达到上述目的，本发明提供了一种FIFO存储器的处理方法，所述FIFO存储器包括数据缓存模块和地址控制模块；所述处理方法包括，
所述地址控制模块接收所述数据缓存模块的空/满状态信号；
所述地址控制模块调整所述数据缓存模块的读写地址差值。
优选的，所述读写地址差值通过寄存器参数配置。
优选的，所述地址控制模块配置所述数据缓存模块的读地址初始值和写地址初始值。
本发明还提供了一种FIFO存储器，包括：数据缓存模块、地址控制模块、写地址总线、读地址总线、写满信号线、读空信号线；
所述地址控制模块与所述数据缓存模块分别通过所述写地址总线、读地址总线、写满信号线、读空信号线电性相连；其中，
所述地址控制模块接收所述数据缓存模块的空/满状态信号；
所述地址控制模块调整所述数据缓存模块的读写地址差值。
优选的，所述读写地址差值通过寄存器参数配置。
优选的，所述地址控制模块配置所述数据缓存模块的读地址初始值和写地址初始值。
优选的，所述FIFO存储器还包括：用于输入写时钟频率的写时钟端口和用于输入读时钟频率的读时钟端口；所述读时钟端口分别与所述数据缓存模块、地址控制模块电性相连；所述写时钟端口分别与所述数据缓存模块、地址控制模块电性相连；其中，所述读时钟频率和写时钟频率二者频率相同、相位不同。
优选的，所述FIFO存储器还包括：复位端口、异常状态指示端口；所述地址控制模块分别与所述复位端口、异常状态指示端口电性相连。
本发明的有益效果在于：提供了一种FIFO存储器的处理方法，当所述地址控制模块接收所述数据缓存模块的空/满状态信号，所述地址控制模块调整所述数据缓存模块的读写地址差值，从而避免指针碰撞导致FIFO存储器异常，保证数据正常通信。
【附图说明】
图1为本发明实施例FIFO存储器的处理方法的流程图；
图2为本发明实施例FIFO存储器的结构示意图。
【具体实施方式】
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