[发明专利]阵列基板的成型方法、阵列基板以及显示装置有效
申请号: | 202011180810.1 | 申请日: | 2020-10-29 |
公开(公告)号: | CN112309969B | 公开(公告)日: | 2022-10-18 |
发明(设计)人: | 赖青俊;朱绎桦;曹兆铿;李晓 | 申请(专利权)人: | 厦门天马微电子有限公司 |
主分类号: | H01L21/77 | 分类号: | H01L21/77;H01L27/12 |
代理公司: | 北京东方亿思知识产权代理有限责任公司 11258 | 代理人: | 臧静 |
地址: | 361101 福建*** | 国省代码: | 福建;35 |
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摘要: | |||
搜索关键词: | 阵列 成型 方法 以及 显示装置 | ||
1.一种阵列基板的成型方法,其特征在于,包括:
在衬底上形成图案化的第一半导体层,所述第一半导体层包括阵列分布的第一有源结构;
在所述第一半导体层背离所述衬底的一侧形成第一绝缘层;
在所述第一绝缘层背离所述衬底的一侧形成图案化的第二半导体层,所述第二半导体层包括间隔分布的第二有源结构以及遮挡结构,所述遮挡结构在所述衬底上的正投影至少部分与所述第一有源结构在所述衬底上的正投影相重叠;
在所述第二半导体层背离所述衬底的一侧形成第一金属层;
图案化所述第一金属层,形成阵列分布的第一栅极,所述遮挡结构在所述衬底上的正投影至少部分与所述第一栅极在所述衬底上的正投影相重叠,且所述遮挡结构在所述衬底上的正投影在所述第一方向的两侧分别凸出于所述第一栅极的正投影;
以所述遮挡结构为遮挡层对所述第一有源结构进行离子植入,以形成第一沟道区以及第一掺杂区,所述第一沟道区在第一方向上的两侧分别形成有所述第一掺杂区;
其中,离子植入后的所述第一掺杂区包括轻掺杂区以及重掺杂区,在所述第一方向,所述轻掺杂区位于所述第一沟道区以及所述重掺杂区之间。
2.根据权利要求1所述的阵列基板的成型方法,其特征在于,所述在所述第二半导体层背离所述衬底的一侧形成第一金属层的步骤之前,所述成型方法还包括:
在所述第二半导体层背离所述衬底的一侧形成第二绝缘层。
3.根据权利要求2所述的阵列基板的成型方法,其特征在于,所述以所述遮挡结构为遮挡层对所述第一有源结构进行离子植入的步骤之前,所述成型方法还包括:
图案化所述第二绝缘层,图案化的所述第二绝缘层包括阵列分布的第一区,所述第一栅极与所述第一区层叠设置,所述第一栅极在所述衬底上的正投影与所述第一区在所述衬底上的正投影相重合。
4.根据权利要求3所述的阵列基板的成型方法,其特征在于,所述图案化所述第一金属层的步骤包括:
在所述第一金属层上铺设掩模板;
刻蚀所述第一金属层,以形成所述第一栅极;
所述图案化所述第二绝缘层的步骤包括:
利用同一所述掩模板,在刻蚀所述第一金属层后,继续刻蚀所述第二绝缘层,以形成所述第一区。
5.根据权利要求1所述的阵列基板的成型方法,其特征在于,所述在所述第一绝缘层背离所述衬底的一侧形成图案化的第二半导体层的步骤之前,所述成型方法还包括:
在所述第一绝缘层背离所述衬底的一侧形成第一金属层;
图案化所述第一金属层,以形成阵列分布的第一栅极;
在图案化的所述第一金属层背离所述衬底的一侧形成第二绝缘层;
所述在所述第一绝缘层背离所述衬底的一侧形成图案化的第二半导体层的步骤中,形成的所述第二半导体层层叠设置于所述第二绝缘层,所述遮挡结构在所述衬底上的正投影至少部分与所述第一栅极在所述衬底上的正投影相重叠,且所述遮挡结构在所述衬底上的正投影在所述第一方向的两侧分别凸出于所述第一栅极的正投影;
所述以所述遮挡结构为遮挡层对各所述第一有源结构进行离子植入的步骤中,离子植入后的所述第一掺杂区包括轻掺杂区以及重掺杂区,在所述第一方向,所述轻掺杂区位于所述第一沟道区以及所述重掺杂区之间。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造