[发明专利]一种JPEG解码方法及装置在审

专利信息
申请号: 202011263958.1 申请日: 2020-11-12
公开(公告)号: CN112437303A 公开(公告)日: 2021-03-02
发明(设计)人: 张云哲;耿嘉;樊平 申请(专利权)人: 北京深维科技有限公司
主分类号: H04N19/172 分类号: H04N19/172;H04N19/174;H04N19/423;H04N19/436;H04N19/625;H04N19/15
代理公司: 北京众达德权知识产权代理有限公司 11570 代理人: 张桂蓉
地址: 100000 北京市*** 国省代码: 北京;11
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摘要:
搜索关键词: 一种 jpeg 解码 方法 装置
【说明书】:

发明公开了一种JPEG解码方法及装置,应用于图像处理领域,FPGA加速卡从FPGA加速卡的DDR上读取M张图片,M为大于1的整数;FPGA加速卡将从DDR上读取的M张图片对应分配给M个JPEG解码器,M个JPEG解码器共用FPGA加速卡上相同的GMEM资源对M张图片进行M路并行的JPEG解码,得到M路解码数据流;FPGA加速卡读取并汇合M路解码数据流,得到汇合后解码数据;将汇合后解码数据输出至DDR。通过本发明提高了JPEG解码效率。

技术领域

本发明属于图像处理领域,尤其涉及一种JPEG解码方法及装置。

背景技术

联合图像专家小组(英语:Joint Photographic Experts Group,缩写:JPEG)是一种针对照片影像而广泛使用的有损压缩标准方法。JPEG本身只有描述如何将一个影像转换为字节的数据流(streaming)。一个由C-Cube Microsystems等公司所创建的额外标准,称为JFIF(JPEG File Interchange Format,JPEG文件交换格式,联合图像专家小组文件交换格式)详细说明如何从一个JPEG流,产出一个适合于电脑存储和传输的文件。

随着加速卡的容量越来越大,在FPGA(Field Programmable Gate Array,现场可编程门阵列)加速卡上进行JPEG解码时,为了最大限度地提升JPEG解码的吞吐,可以在FPGA加速卡上放置更多的内核。但是,每个内核要占用一定数量的GMEM资源,每张加速卡上的GMEM(高速缓存)资源是受限的,从而会限制放置更多的内核,进而限制了FPGA的JPEG解码效率。

发明内容

鉴于现有技术存在上述问题,本发明实施例提出了一种JPEG解码方法及装置,用以提高JPEG解码效率。

第一方面,本发明实施例提供一种JPEG解码方法,应用于FPGA加速卡,所述方法包括:

从FPGA加速卡的DDR上读取M张图片,M为大于1的整数;

将从所述DDR上读取的M张图片对应分配给M个JPEG解码器,所述M个JPEG解码器共用所述FPGA加速卡上相同的GMEM资源对所述M张图片进行M路并行的JPEG解码,得到M路解码数据流;

读取并汇合所述M路解码数据流,得到汇合后解码数据;

将所述汇合后解码数据输出至所述DDR。

可选地,所述从FPGA加速卡的DDR上读取M张图片的数据片段,包括:

基于预设的读入顺序和数据片段大小,依次从所述DDR上读取所述M张图片的数据片段,直到所述M张图片的数据均读取完毕。

可选地,所述基于预设的读入顺序和数据片段大小,依次从所述DDR上读取所述M张图片的数据片段,包括:

判断针对所述M张图片的第一整体状态,所述第一整体状态表征所述M张图片是否均已读入完成;

如果所述第一整体状态为否,则轮询检查所述M张图片中的每张图片的数据是否存在数据,如果当前检查图片中存在数据,则从所述当前检查图片中读入下一个数据片段,并更新所述当前检查图片的数据状态;

根据所述M张图片中每张图片的数据状态,更新所述第一整体状态,并返回所述判断针对所述M张图片的第一整体状态的步骤。

可选地,所述读取并汇合所述M路解码数据流,得到汇合后解码数据,包括:

基于预设的读出顺序,依次从所述M路解码数据流上读出解码后数据片段;

汇合从所述M路解码数据流上读出的解码后数据片段,得到汇合后解码数据。

可选地,所述基于预设的读出顺序,从所述M路解码数据流上读出解码后数据片段,包括:

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