[发明专利]多核SoC芯片的自动化验证方法、系统及装置有效

专利信息
申请号: 202011334559.X 申请日: 2020-11-24
公开(公告)号: CN112580295B 公开(公告)日: 2022-07-05
发明(设计)人: 黎金旺;张彦欣;贺龙龙;宁振海;杨小坤;李德建;杨立新;谭浪;白志华;刘胜;唐志军;李智诚 申请(专利权)人: 北京智芯微电子科技有限公司;国网信息通信产业集团有限公司;国网福建省电力有限公司;国网福建省电力有限公司电力科学研究院;国家电网有限公司
主分类号: G06F30/398 分类号: G06F30/398;G06F30/394;G06F30/392;G06F30/327;G06F115/02;G06F117/08
代理公司: 北京润平知识产权代理有限公司 11283 代理人: 肖冰滨;王晓晓
地址: 100192 北京市海淀区*** 国省代码: 北京;11
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摘要:
搜索关键词: 多核 soc 芯片 自动化 验证 方法 系统 装置
【说明书】:

发明提供一种多核SoC芯片的自动化验证方法、系统及装置,属于芯片测试验证技术领域。所述方法包括:分割多核SoC芯片的数字电路的代码;综合分割的数字电路的代码为与至少两片FPGA芯片对应的网表;根据所述网表,对所述至少两片FPGA芯片的电路镜像进行布局布线,布局布线后生成硬件待验证文件;部署所述硬件待验证文件至具有所述至少两片FPGA芯片的验证系统;编译所述多核SoC芯片的多核处理器程序代码,编译后获得软件待验证文件;部署所述软件待验证文件至所述验证系统,对部署后的验证系统执行所述多核SoC芯片流片前的验证。本发明可用于SoC或MCU的芯片流片前原型验证。

技术领域

本发明涉及芯片测试验证技术领域,具体地涉及一种多核SoC芯片的自动化验证方法、一种多核SoC芯片的自动化验证系统、一种多核SoC芯片的自动化验证装置、一种电子设备和一种计算机可读存储介质。

背景技术

随着半导体技术的飞速进步和体系结构的不断发展,使得处理器CPU(CentralProcessing Unit)的性能不断提高,处理器也由原来的单核、双核,发展到现在的多核心技术。由于多核处理器强大的性能,被各领域终端设备广泛应用,同时越来越多的片上系统(型)芯片SoC(System on Chip)或者主控芯片MCU(Micro Control Unit)中都集成多核处理器,这样必然增大了芯片的逻辑资源、设计复杂度和技术难度。同时,多核技术也给SoC的芯片系统设计、软硬件协同处理、现场可编程逻辑门阵列FPGA(Field Pro-grammable GateArray)硬件平台设计和FPGA验证带来了严苛的要求和严重的挑战,而目前现有的SoC或MCU芯片的验证框架大多还是单核系统框架,主要是将SoC或MCU芯片设计映射至一片FPGA芯片,因此,需要有支持多核处理器芯片的自动化验证方法和FPGA验证系统或平台。

发明内容

本发明的目的是提供一种多核SoC芯片的自动化验证方法、系统及装置,采用工具软件和预先设计的脚本,实现了复杂的多核SoC芯片的自动化验证系统,解决了多核SoC芯片代码分割、综合布局布线和生成映射文件、及软硬件协同验证等复杂的设计流程问题,避免多核SoC芯片的数字电路代码例化至FPGA芯片导致的多个CPU核间的软硬件协同特性验证困难,提高了多核SoC芯片设计的工作效率和正确性。

为了实现上述目的,本发明实施例提供一种多核SoC芯片的自动化验证方法,该自动化验证方法包括:

分割多核SoC芯片的数字电路的代码;

综合分割的数字电路的代码为与至少两片FPGA芯片对应的网表;

根据所述网表,对所述至少两片FPGA芯片的电路镜像进行布局布线,布局布线后生成硬件待验证文件;

部署所述硬件待验证文件至具有所述至少两片FPGA芯片的验证系统;

编译所述多核SoC芯片的多核处理器程序代码,编译后获得软件待验证文件;

部署所述软件待验证文件至所述验证系统,对部署后的验证系统执行所述多核SoC芯片流片前的验证。

具体的,所述分割多核SoC芯片的数字电路的代码,包括:

根据多核SoC芯片的数字电路的代码结构,通过在工具软件上执行配置的脚本文件识别所述多核SoC芯片的总线架构信息;

按照所述总线架构信息分割所述多核SoC芯片的数字电路的代码。

具体的,所述按照所述总线架构信息分割所述多核SoC芯片的数字电路的代码,其中,

与所述多核SoC芯片内的CPU内核对应的数字电路的代码被分别独立分割为内核模块,

与所述多核SoC芯片内的总线架构对应的数字电路的代码被分割为总线模块,

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