[发明专利]半导体器件及其制备方法有效
申请号: | 202011561789.X | 申请日: | 2020-12-25 |
公开(公告)号: | CN112687693B | 公开(公告)日: | 2022-07-19 |
发明(设计)人: | 郭亚丽;许波;刘思敏;吴智鹏;徐伟 | 申请(专利权)人: | 长江存储科技有限责任公司 |
主分类号: | H01L27/11519 | 分类号: | H01L27/11519;H01L27/11524;H01L27/11556;H01L27/11565;H01L27/1157;H01L27/11582 |
代理公司: | 深圳紫藤知识产权代理有限公司 44570 | 代理人: | 杨艇要 |
地址: | 430205 湖北省武汉*** | 国省代码: | 湖北;42 |
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摘要: | |||
搜索关键词: | 半导体器件 及其 制备 方法 | ||
1.一种半导体器件,其特征在于,所述半导体器件包括:
衬底;
堆叠结构,设置于所述衬底上方,且包括交替层叠的绝缘层和栅极层,所述堆叠结构包括第一区域和第二区域,所述第一区域为虚拟区域,所述第二区域为器件区域;
第一栅线狭缝结构,垂直贯穿所述堆叠结构,且沿第一方向延伸,所述第一栅线狭缝结构位于所述第一区域;
第二栅线狭缝结构,垂直贯穿所述堆叠结构,且沿第二方向延伸,所述第二栅线狭缝结构位于所述第一区域,且所述第一区域和所述第二区域沿所述第二方向延伸;
其中,所述第一栅线狭缝结构包括多个间断的子栅线狭缝结构,所述第二栅线狭缝结构设置于所述子栅线狭缝结构的间断处,且在所述衬底平面内,所述第一方向与所述第二方向具有夹角。
2.根据权利要求1所述的半导体器件,其特征在于,所述第二区域具有沿所述第一方向延伸的第三栅线狭缝结构,所述第三栅线狭缝结构用以将所述第二区域中的所述堆叠结构沿所述第二方向划分为多个块状结构。
3.根据权利要求1所述的半导体器件,其特征在于,所述第一区域包括沿所述第一方向排列的第一存储区以及第一阶梯区,所述第二区域包括沿所述第一方向排列的第二存储区以及第二阶梯区。
4.根据权利要求3所述的半导体器件,其特征在于,所述第二栅线狭缝结构位于所述第一存储区。
5.根据权利要求4所述的半导体器件,其特征在于,所述第二栅线狭缝结构还位于所述第一阶梯区。
6.根据权利要求1所述的半导体器件,其特征在于,所述第一栅线狭缝结构以及所述第二栅线狭缝结构的材料包括多晶硅以及钨。
7.根据权利要求1所述的半导体器件,其特征在于,所述第一栅线狭缝结构以及所述第二栅线狭缝结构的材料还包括氧化铝以及氮化钛其中至少之一。
8.一种半导体器件的制备方法,其特征在于,所述制备方法包括:
提供衬底;
在所述衬底上形成堆叠结构,所述堆叠结构包括交替层叠的绝缘层和牺牲层,所述堆叠结构包括第一区域和第二区域,所述第一区域为虚拟区域,所述第二区域为器件区域;
形成垂直贯穿所述堆叠结构、且沿第一方向延伸的第一栅线狭缝结构,所述第一栅线狭缝结构位于所述第一区域;
形成垂直贯穿所述堆叠结构、且沿第二方向延伸的第二栅线狭缝结构,所述第二栅线狭缝结构位于所述第一区域,且所述第一区域和所述第二区域沿所述第二方向延伸;
将所述牺牲层置换为栅极层;
其中,所述第一栅线狭缝结构包括多个间断的子栅线狭缝结构,所述第二栅线狭缝结构设置于所述子栅线狭缝结构的间断处,且在所述衬底平面内,所述第一方向与所述第二方向具有夹角。
9.根据权利要求8所述的制备方法,其特征在于,在所述将所述牺牲层置换为栅极层的步骤之前,还包括:
在所述第二区域形成垂直贯穿所述堆叠结构、且沿所述第一方向延伸的第三栅线狭缝结构;
其中,所述第三栅线狭缝结构用以将所述第二区域中的所述堆叠结构沿所述第二方向划分为多个块状结构。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的