[发明专利]一种时钟控制电路及终端设备有效

专利信息
申请号: 202011593804.9 申请日: 2020-12-29
公开(公告)号: CN113051208B 公开(公告)日: 2023-09-19
发明(设计)人: 丁永波;刘桥平;何刚生 申请(专利权)人: 深圳微步信息股份有限公司
主分类号: G06F13/42 分类号: G06F13/42;G06F13/38
代理公司: 深圳市徽正知识产权代理有限公司 44405 代理人: 卢杏艳
地址: 518000 广东省深圳市南山区*** 国省代码: 广东;44
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摘要:
搜索关键词: 一种 时钟 控制电路 终端设备
【权利要求书】:

1.一种时钟控制电路,其特征在于,包括服务器的处理器和桌面平台控制器,其中,所述服务器的处理器的BCLK0与所述桌面平台控制器的CLK-PEGA_P/N相连,所述服务器的处理器的BCLK1与所述桌面平台控制器的CLK-DMI_P/N相连;

所述桌面平台控制器的CLK-PEGB_P/N连接PCIE-X16插槽;

所述桌面平台控制器的CLK-PE1_P/N连接PCIE-X1插槽;

所述桌面平台控制器的CLK-PE2_P/N连接PCIE-LAN;

所述桌面平台控制器的LPC-CLK连接SIO芯片;

所述服务器的处理器的时序接口、复位接口、状态指示接口与所述桌面平台控制器相连;

所述服务器的处理器为Intel E5-16xx v3/v4或 IntelE5-26xx v3/v4系列服务器的处理器;

所述桌面平台控制器为Intel 8 系列芯片组,包括H81、Q87、Q85、B85、Z87、H87桌面平台系列。

2.根据权利要求1所述的时钟控制电路,其特征在于,所述服务器的处理器通过DMI与所述桌面平台控制器相连。

3.根据权利要求2所述的时钟控制电路,其特征在于,所述服务器的处理器的第一发送接口与所述桌面平台控制器的第二接收接口相连,所述服务器的处理器的第一接收接口与所述桌面平台控制器的第二发送接口相连。

4.根据权利要求1所述的时钟控制电路,其特征在于,所述服务器的处理器还包括内存通道接口和扩展总线接口。

5.根据权利要求1所述的时钟控制电路,其特征在于,所述服务器的处理器的内存通道接口的数量为1-4个。

6.根据权利要求4所述的时钟控制电路,其特征在于,所述扩展总线接口为PCIE插槽,所述PCIE插槽的数量小于40。

7.根据权利要求1所述的时钟控制电路,其特征在于,所述桌面平台控制器包括SATA接口、PCIE接口、LAN接口、USB接口、Audio接口。

8.一种终端设备,其特征在于,包括权利要求1-7任意一项所述的时钟控制电路。

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