[发明专利]用于蚀刻临界尺寸控制的非共形高选择性膜在审
申请号: | 202080068046.0 | 申请日: | 2020-08-11 |
公开(公告)号: | CN114450773A | 公开(公告)日: | 2022-05-06 |
发明(设计)人: | B·齐;王慧圆;Y·饶;A·B·玛里克 | 申请(专利权)人: | 应用材料公司 |
主分类号: | H01L21/311 | 分类号: | H01L21/311;H01L21/8242;H01L27/11524;H01L27/11556;H01L27/1157;H01L27/11582;C23C16/01;C23C16/04;C23C16/34;C23C16/40 |
代理公司: | 上海专利商标事务所有限公司 31100 | 代理人: | 史起源;侯颖媖 |
地址: | 美国加利*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 用于 蚀刻 临界 尺寸 控制 非共形高 选择性 | ||
1.一种方法,包括:
在基板上形成膜堆叠,所述膜堆叠包括氧化材料和氮化材料的多个交替层,并且所述膜堆叠具有堆叠厚度;
蚀刻所述膜堆叠至第一深度,以形成具有至少一个侧壁和底部的开口,所述第一深度小于所述厚度;
在所述开口的所述至少一个侧壁和所述底部上沉积非共形衬垫,在所述开口的所述底部上的所述非共形衬垫具有厚度,所述厚度小于在所述开口的所述至少一个侧壁上的所述非共形衬垫的厚度;
从所述开口的所述底部蚀刻所述非共形衬垫;
相对于所述非共形衬垫选择性蚀刻所述膜堆叠至第二深度,以形成孔洞;以及
移除所述非共形衬垫。
2.如权利要求1所述的方法,其中所述堆叠厚度在约1μM至约10μM的范围中。
3.如权利要求1所述的方法,进一步包括:在蚀刻之前在所述膜堆叠上形成图案化硬掩模。
4.如权利要求3所述的方法,其中在所述图案化硬掩模中的开口暴露待蚀刻的所述膜堆叠的部分。
5.如权利要求4所述的方法,其中在所述图案化硬掩模中的所述开口具有在约1nm至约3000nm的范围中的宽度。
6.如权利要求1所述的方法,其中所述非共形衬垫包括以下项中的一者或多者:硼、碳或氮。
7.如权利要求1所述的方法,其中所述非共形衬垫通过化学气相沉积来沉积。
8.如权利要求1所述的方法,其中所述非共形衬垫通过将所述基板暴露至含硼前驱物和反应物而形成。
9.如权利要求1所述的方法,其中所述孔洞包括以下项中的一者或多者:存储器孔洞或字符线缝。
10.如权利要求1所述的方法,其中所述第二深度在约1μM至约10μM的范围中。
11.如权利要求1所述的方法,其中所述孔洞具有约50nm的减少的弓曲临界尺寸。
12.如权利要求1所述的方法,其中所述非共形衬垫具有在约1nm至约50nm的范围中的厚度。
13.如权利要求1所述的方法,其中所述非共形衬垫通过工艺移除,所述工艺包括在氧化环境中的退火。
14.如权利要求13所述的方法,其中所述退火在大于或等于约500℃的温度下执行。
15.一种方法,包括:
在基板上形成膜堆叠,所述膜堆叠包括氧化材料和氮化材料的多个交替层,并且所述膜堆叠具有堆叠厚度;
在所述膜堆叠上形成图案化硬掩模;
通过所述硬掩模蚀刻所述膜堆叠至第一深度,以形成具有至少一个侧壁和底部表面的开口,所述第一深度小于所述堆叠厚度;
通过原子层沉积,在所述开口的所述至少一个侧壁和所述底部表面上沉积非共形衬垫,在所述开口的所述底部表面上的所述非共形衬垫具有厚度,所述厚度小于在所述开口的所述至少一个侧壁上的所述非共形衬垫的厚度,所述非共形衬垫包括以下项中的一者或多者:硼、氮或碳;
从所述开口的所述底部表面蚀刻所述非共形衬垫;
相对于所述非共形衬垫选择性蚀刻所述膜堆叠至第二深度,以形成孔洞;以及
执行所述基板的退火,以移除所述非共形衬垫。
16.如权利要求15所述的方法,其中所述非共形衬垫通过将所述基板暴露至含硼前驱物和反应物而形成。
17.如权利要求16所述的方法,其中所述非共形衬垫具有在约1nm至约50nm的范围中的厚度。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造