[发明专利]半导体晶片的检测方法在审
申请号: | 202110102203.1 | 申请日: | 2021-01-26 |
公开(公告)号: | CN113611620A | 公开(公告)日: | 2021-11-05 |
发明(设计)人: | 王龙 | 申请(专利权)人: | 联芯集成电路制造(厦门)有限公司 |
主分类号: | H01L21/66 | 分类号: | H01L21/66 |
代理公司: | 北京市柳沈律师事务所 11105 | 代理人: | 陈小雯 |
地址: | 361100 福建*** | 国省代码: | 福建;35 |
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摘要: | |||
搜索关键词: | 半导体 晶片 检测 方法 | ||
1.一种半导体晶片的检测方法,包含:
提供晶片,该晶片上定义有多个区域,该多个区域中至少包含有第一区域以及第二区域;
进行第一次光刻步骤,以曝露该多个区域中的该第一区域;
进行第一次离子注入步骤,在该第一区域内掺杂离子,其中该第一区域内具有第一离子注入浓度;
进行第二次光刻步骤,以曝露该多个区域中的该第二区域;
进行第二次离子注入步骤,在该第二区域内掺杂离子,其中该第二区域内具有第二离子注入浓度;以及
分别检测该第一区域与该第二区域的电性特征。
2.如权利要求1所述的检测方法,其中,该多个区域还包含有第三区域以及第四区域,且该检测方法还包含:
进行第三次光刻步骤,以曝露该多个区域中的该第三区域;
进行第三次离子注入步骤,在该第三区域内掺杂离子,其中该第一区域内具有第三离子注入浓度;
进行第四次光刻步骤,以曝露该多个区域中的该第四区域;
进行第四次离子注入步骤,在该第四区域内掺杂离子,其中该第四区域内具有第四离子注入浓度;
分别检测该第一区域、该第二区域、该第三区域与该第四区域的电性特征。
3.如权利要求2所述的检测方法,其中该第一离子注入浓度、该第二离子注入浓度、该第三离子注入浓度与该第四离子注入浓度各不相同。
4.如权利要求1所述的检测方法,其中,曝露该第一区域与该第二区域的方法包含:
在该晶片上全面性形成第一光致抗蚀剂层;
利用第一光掩模,以该第一次光刻步骤移除部分该第一光致抗蚀剂层,并且曝露该第一区域;
全面性移除该第一光致抗蚀剂层,并重新形成第二光致抗蚀剂层于该晶片上;
利用该第一光掩模,以该第二次光刻步骤移除部分该第二光致抗蚀剂层,并且曝露该第二区域。
5.如权利要求4所述的检测方法,其中,当该第二区域被曝露时,该第一区域被该第二光致抗蚀剂层所覆盖。
6.如权利要求1所述的检测方法,其中,曝露该第一区域与该第二区域的方法包含:
在该晶片上全面性形成第一光致抗蚀剂层;
进行该第一次光刻步骤,将一曝光光线聚焦在该第一区域内,并且将该第一区域内的该第一光致抗蚀剂层移除;
移除该第一光致抗蚀剂层,并且在该晶片上形成第二光致抗蚀剂层;
进行该第二次光刻步骤,将另一曝光光线聚焦在该第二区域内,并且将该第二区域内的该第二光致抗蚀剂层移除。
7.如权利要求1所述的检测方法,其中,分别检测该第一区域与该第二区域的电性特征的步骤包含:
分别在该第一区域与该第二区域内形成至少一电子元件;以及
分别对该第一区域与该第二区域内的该电子元件进行晶片允收测试(waferacceptance test,WAT)。
8.一种半导体晶片的检测方法,包含:
提供晶片,该晶片上定义有多个区域,该多个区域中至少包含有第一区域以及第二区域;
进行第一次光刻步骤,以第一曝光能量,曝露该多个区域中的该第一区域,并且在该第一区域内形成第一图案,其中该第一图案具有第一曝光极值;
进行第二次光刻步骤,以第二曝光能量,曝露该多个区域中的该第二区域,并且在该第二区域内形成第二图案,其中该第二图案具有第二曝光极值;以及
分别检测该第一区域与该第二区域的电性特征。
9.如权利要求8所述的检测方法,其中进行该第一次光刻步骤与进行该的二次光刻步骤时,使用同一光掩模。
10.如权利要求8所述的检测方法,其中,分别检测该第一区域与该第二区域的电性特征的步骤包含:
分别在该第一区域与该第二区域内形成至少一电子元件;以及
分别对该第一区域与该第二区域内的该电子元件进行晶片允收测试(waferacceptance test,WAT)。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造