[发明专利]半导体器件及其制造方法在审
申请号: | 202110191604.9 | 申请日: | 2021-02-19 |
公开(公告)号: | CN113284847A | 公开(公告)日: | 2021-08-20 |
发明(设计)人: | 詹宏伟;郑咏世;黄文社 | 申请(专利权)人: | 台湾积体电路制造股份有限公司 |
主分类号: | H01L21/822 | 分类号: | H01L21/822;H01L21/768;H01L23/64;H01L23/538;H01L27/06 |
代理公司: | 北京德恒律治知识产权代理有限公司 11409 | 代理人: | 章社杲;李伟 |
地址: | 中国台*** | 国省代码: | 台湾;71 |
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摘要: | |||
搜索关键词: | 半导体器件 及其 制造 方法 | ||
1.一种制造半导体器件的方法,包括:
形成导电部件和第一穿通停止层,其中,所述导电部件具有第一顶表面,并且其中所述第一穿通停止层具有与所述第一顶表面基本齐平的第二顶表面;
在所述第一穿通停止层上方形成电阻元件;
蚀刻穿过所述电阻元件的第一部分以形成第一沟槽,所述第一沟槽暴露所述第一穿通停止层的所述第二顶表面和电阻元件的第一侧壁表面;以及
在所述第一沟槽内形成第一导电通孔,其中所述第一导电通孔接触所述电阻元件的所述第一侧壁表面。
2.根据权利要求1所述的制造半导体器件的方法,其中,所述导电部件形成在所述半导体器件的逻辑区域内,并且其中,所述第一穿通停止层形成在所述半导体器件的电阻器区域内。
3.根据权利要求1所述的制造半导体器件的方法,其中,所述导电部件提供了多层金属互连结构的部分。
4.根据权利要求3所述的制造半导体器件的方法,其中,所述导电部件和所述第一穿通停止层形成在所述多层金属互连结构的相同金属互连层级内。
5.根据权利要求1所述的制造半导体器件的方法,还包括:
在形成所述电阻元件之前,在所述导电部件和所述第一穿通停止层两者上形成电阻层;以及
图案化所述电阻层,以去除所述电阻层的位于所述导电部件上方的部分,并在所述第一穿通停止层上方形成电阻元件。
6.根据权利要求1所述的制造半导体器件的方法,还包括:
在形成所述电阻元件之前,形成第二穿通停止层,其中所述第二穿通停止层具有第三顶表面,所述第三顶表面与所述第一顶表面和第二顶表面基本齐平。
7.根据权利要求6所述的制造半导体器件的方法,还包括:
在形成所述第一导电通孔之前,蚀刻穿过所述电阻元件的第二部分以形成第二沟槽,所述第二沟槽暴露所述第二穿通停止层的所述第三顶表面和所述电阻元件的第二侧壁表面二者;以及
在所述第二沟槽内形成第二导电通孔,其中所述第二导电通孔接触所述电阻元件的所述第二侧壁表面。
8.根据权利要求1所述的制造半导体器件的方法,还包括:
在蚀刻穿过所述电阻元件的所述第一部分之前,在所述电阻元件上方沉积介电层;
蚀刻穿过所述介电层的部分和所述电阻元件的所述第一部分二者以形成所述第一沟槽;
在所述第一沟槽内形成所述第一导电通孔;以及
在所述第一导电通孔上方的第一沟槽内形成第一导线。
9.一种制造半导体器件的方法,包括:
在设置于衬底上方的第一介电层内形成第一穿通停止层和第二穿通停止层,其中,所述第一穿通停止层和所述第二穿通停止层基本彼此齐平;
在所述第一穿通停止层和第二穿通停止层上方沉积多个层,所述多个层包括电阻层;
形成暴露所述第一穿通停止层的第一沟槽和暴露所述第二穿通停止层的第二沟槽;以及
在所述第一沟槽内形成第一导电通孔,并在所述第二沟槽内形成第二导电通孔,其中所述第一导电通孔接触所述电阻层的第一区域,并且其中所述第二导电通孔接触所述电阻层的第二区域。
10.一种半导体器件,包括:
第一金属线;
第一穿通停止层,所述第一穿通停止层的第一顶表面与所述第一金属线的第二顶表面基本齐平;
电阻元件,设置在所述第一穿通停止层上方;以及
第一导电通孔,接触所述第一穿通停止层的所述第一顶表面和所述电阻元件的第一侧壁表面二者。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造