[发明专利]一种层次化保护装置有效

专利信息
申请号: 202110443194.2 申请日: 2021-04-23
公开(公告)号: CN113111027B 公开(公告)日: 2023-01-24
发明(设计)人: 刘玮;王增超;李一泉;邓旭阳;黄明辉;王育学;索江镭;袁亮荣;付元欢;梁博 申请(专利权)人: 广东电网有限责任公司电力调度控制中心
主分类号: G06F15/163 分类号: G06F15/163;G06F13/42
代理公司: 广州三环专利商标代理有限公司 44202 代理人: 陈旭红;吕金金
地址: 510000 广*** 国省代码: 广东;44
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摘要:
搜索关键词: 一种 层次 保护装置
【权利要求书】:

1.一种层次化保护装置,其特征在于,包括:

电源板卡,用于为开入开出板卡、PCIe高速采集板卡及CPU板卡供电;还用于将220V或110V交直流输入电源转换为24V和5V电源为所述开入开出板卡、所述PCIe高速采集板卡及所述CPU板卡供电;

所述开入开出板卡,与所述PCIe高速采集板卡电连接,包括开入模块和开出模块;所述开入模块用于装置检修及远方状态的硬压板输入,所述开出模块用于装置失电、故障告警空状态的输出;

所述PCIe高速采集板卡,用于SV、GOOSE数据的编码、解码及站域广域保护计算;其中,所述PCIe高速采集板卡包括计算单元、PCRAM存储器及FPGA;所述PCRAM存储器包括重要数据保存区和计算模型存储区;所述计算模型存储区用于存储及更新计算模型,所述更新计算模型包括MCU根据所述FPGA调用所述PCRAM存储器的计算模型的计算结果进行判断;若判断结果为执行参数修改,则由所述FPGA执行;若判断结果为执行模型修正,则由所述MCU通过所述FPGA的并口对所述计算模型进行修正,并使所述FPGA载入修正后的模型;其中,所述PCIe高速采集板卡的数量为至少两个,且至少两个所述PCIe高速采集板卡之间通过LVDS总线进行通信;所述PCRAM存储器采用的型号为4MSRM40;所述计算单元采用T3-四核A7芯片;

所述PCIe高速采集板卡与所述CPU板卡利用PCIe接线进行通讯,且利用PPS对时线进行对时;所述PCIe高速采集板卡设有4路千兆光以太网口;

所述CPU板卡,用于接收所述PCIe高速采集板卡发送的SV/GOOSE数据,并通过SDH与其他站域保护进行交互;还用于资源管理、定值管理、报告处理、MMS通讯或对时服务;所述CPU板卡采用X86架构CPU板,且采用多核Intel CPU及Linux操作系统。

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