[发明专利]海思编解码芯片实现多画面叠加的方法和系统在审

专利信息
申请号: 202110477117.9 申请日: 2021-04-29
公开(公告)号: CN113163137A 公开(公告)日: 2021-07-23
发明(设计)人: 彭雪昭;陶帅;李国明 申请(专利权)人: 众立智能科技(深圳)有限公司
主分类号: H04N5/265 分类号: H04N5/265;H04N5/262;H04N7/18;H04N19/42
代理公司: 深圳市中科创为专利代理有限公司 44384 代理人: 彭西洋;彭涛
地址: 518000 广东省深圳市龙华区大*** 国省代码: 广东;44
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摘要:
搜索关键词: 海思编 解码 芯片 实现 画面 叠加 方法 系统
【权利要求书】:

1.海思编解码芯片实现多画面叠加的方法,其特征在于该方法包括:

S1,获取多画面,对每一画面上不同类型物体进行参照物识别,形成参照物集合;

S2、指定其一画面为背景画面,其余画面为待叠加画面;

S3,以背景画面为基准,依次调整待叠加画面角度,使其与背景画面上同类型参照物偏移量最小进行画面叠加合成;

其中,画面叠加合成通过海思编解码芯片完成。

2.根据权利要求1所述的海思编解码芯片实现多画面叠加的方法,其特征在于,所述参照物偏移量根据如下公式来确定:

其中:

f表示,偏移描述函数;

Δ表示,偏移量的差额;

θ表示,叠加画面偏转的角度,0°≤θ≤360°;

Δn表示,第n参照物的偏移量,n为正整数。

3.根据权利要求1所述的海思编解码芯片实现多画面叠加的方法,其特征在于,步骤S1识别的参照物的数量为3个,且不在同一条直线上。

4.根据权利要求1所述的海思编解码芯片实现多画面叠加的方法,其特征在于:所述叠加画面的个数为3个。

5.根据权利要求1所述的海思编解码芯片实现多画面叠加的方法,其特征在于:所述叠加画面位于背景画面的上层。

6.根据权利要求1所述的海思编解码芯片实现多画面叠加的方法,其特征在于,画面叠加合成前通过海思芯片的VPSS缩放模块对叠加画面进行偏移、旋转、裁剪或缩放。

7.海思编解码芯片实现多画面叠加的系统,其特征在于包括:

画面输入源、海思编解码芯片、画面显示端、编辑器;

所述海思编解码芯片包含:VPSS缩放模块、VDEC视频解码模块、VENC视频编码模块、显示帧缓冲区、VO模块;

所述画面输入源将画面信息输送到VENC视频编码模块,经过VENC视频编码模块处理的画面信息发送给VPSS缩放模块进行偏移、旋转、缩放、裁剪、合成处理,编辑器与海思编解码芯片的VPSS缩放模块连接,进行画面的编辑工作,处理后的画面通过VDEC视频解码模块处理,通过IVE模块拷贝到显示帧缓冲区,由VO模块将显示帧缓冲区的画面信息传递给画面显示端显示。

8.根据权利要求7所述的海思编解码芯片实现多画面叠加的系统,其特征在于:所述编辑器包含用户操作界面。

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