[发明专利]存储器电路及其操作方法在审
申请号: | 202110504049.0 | 申请日: | 2021-05-10 |
公开(公告)号: | CN113539316A | 公开(公告)日: | 2021-10-22 |
发明(设计)人: | 苏晋毅;邹宗成;池育德;林钲峻 | 申请(专利权)人: | 台湾积体电路制造股份有限公司 |
主分类号: | G11C8/12 | 分类号: | G11C8/12;G11C7/06;G11C5/14;G11C11/40 |
代理公司: | 北京德恒律治知识产权代理有限公司 11409 | 代理人: | 章社杲;李伟 |
地址: | 中国台*** | 国省代码: | 台湾;71 |
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摘要: | |||
搜索关键词: | 存储器 电路 及其 操作方法 | ||
1.一种存储器电路,包括:
第一驱动器电路;
第一存储器单元列,耦合至所述第一驱动器电路;
第一电流源;
跟踪电路,被配置为跟踪所述第一存储器单元列的泄漏电流;以及
脚部电路,耦合至所述第一存储器单元列、所述第一电流源和所述跟踪电路。
2.根据权利要求1所述的存储器电路,其中,所述跟踪电路包括:
第二驱动器电路;以及
第一跟踪单元列,被配置为跟踪所述第一存储器单元列的泄漏电流,并且耦合在第一导电线与第二导电线之间,所述第一导电线耦合至所述第二驱动器电路。
3.根据权利要求2所述的存储器电路,其中,所述第二驱动器电路包括:
第一放大器,包括第一输入端子、第二输入端子和第一输出端子;以及
第一晶体管,包括第一栅极、第一漏极和第一源极,其中所述第一栅极耦合至所述第一输出端子,所述第一漏极耦合至所述第二输入端子和所述第一导电线,并且所述第一源极耦合至第一电压源,并且所述第二导电线耦合至不同于所述第一电压源的第二电压源。
4.根据权利要求3所述的存储器电路,还包括:
第二晶体管,包括第二栅极、第二漏极和第二源极,其中所述第二栅极耦合至所述第一输出端子和所述第一栅极,所述第二漏极至少耦合至第一节点,并且所述第二源极耦合至所述第一电压源。
5.根据权利要求4所述的存储器电路,还包括:
第一传输门,包括:所述第一传输门的第一输入端子,所述第一输入端子通过所述第一节点耦合至所述第二漏极;所述第一传输门的第二输入端子,所述第二输入端子被配置为接收第一使能信号;所述第一传输门的第三输入端子,所述第三输入端子被配置为接收第二使能信号;所述第一传输门的第一输出端子,所述第一输出端子耦合至第二节点;
第三晶体管,包括第三栅极、第三漏极和第三源极,其中所述第三源极耦合至所述第一电压源;以及
第二传输门,包括:所述第二传输门的第一输入端子,所述第一输入端子耦合至所述第三漏极;所述第二传输门的第二输入端子,所述第二输入端子被配置为接收第三使能信号;所述第二传输门的第三输入端子,所述第三输入端子被配置为接收第四使能信号;所述第二传输门的第一输出端子,所述第一输出端子至少耦合至所述第二节点,所述第二节点耦合至所述脚部电路。
6.根据权利要求5所述的存储器电路,还包括:
第四晶体管,包括第四栅极、第四漏极和第四源极,其中所述第四源极耦合至所述第一电压源;
第三传输门,包括:所述第三传输门的第一输入端子,所述第一输入端子耦合至所述第四漏极;所述第三传输门的第二输入端子,所述第二输入端子被配置为接收第五使能信号;所述第三传输门的第三输入端子,所述第三输入端子被配置为接收第六使能信号;所述第三传输门的第一输出端子,所述第一输出端子至少耦合至所述第二节点,
其中,所述第一输出端子、所述第一栅极、所述第二栅极、所述第三栅极和所述第四栅极中的每一个耦合在一起,以及
所述第一传输门的所述第一输出端子、所述第二传输门的所述第一输出端子、所述第三传输门的所述第一输出端子中的每一个与所述第二节点耦合在一起。
7.根据权利要求4所述的存储器电路,其中,所述脚部电路包括:
第三晶体管,包括第三栅极、第三漏极和第三源极,其中所述第三漏极通过第三导电线耦合至所述第一节点、所述第二漏极、所述第一电流源和所述第二漏极,并且所述第三源极耦合至所述第二电压源;以及
第四晶体管,包括第四栅极、第四漏极和第四源极,其中所述第四栅极耦合至所述第三栅极和所述第一电流源,所述第四漏极耦合至与所述第一存储器单元列耦合的第四导电线的第一端,所述第四源极耦合至所述第二电压源,并且所述第三漏极的第一电流等于所述第四漏极的第二电流。
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