[发明专利]FPGA芯片验证方法、系统、设备及存储介质在审
申请号: | 202110813987.9 | 申请日: | 2021-07-19 |
公开(公告)号: | CN113705141A | 公开(公告)日: | 2021-11-26 |
发明(设计)人: | 李晓艳;张勇;温长清 | 申请(专利权)人: | 深圳市紫光同创电子有限公司 |
主分类号: | G06F30/34 | 分类号: | G06F30/34 |
代理公司: | 深圳国新南方知识产权代理有限公司 44374 | 代理人: | 周雷 |
地址: | 518000 广东省深圳市南山区粤海*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | fpga 芯片 验证 方法 系统 设备 存储 介质 | ||
1.一种FPGA芯片验证方法,其特征在于,包括:
获取目标FPGA芯片和位流文件,所述目标FPGA芯片被划分为若干个电路区域,所述位流文件被划分为若干个数据区域,所述电路区域与所述数据区域一一对应;
将每一数据区域中的数据强制赋值给对应电路区域的配置点,以对所述目标FPGA芯片进行仿真验证。
2.根据权利要求1所述的FPGA芯片验证方法,其特征在于,所述目标FPGA芯片的若干个电路区域的划分步骤,包括:
对所述目标FPGA芯片按照IO BANK进行划分,获取若干时钟区域;
根据所述目标FPGA芯片的电路结构,将每一时钟区域划分为若干电路区域。
3.根据权利要求2所述的FPGA芯片验证方法,其特征在于,所述位流文件的若干个数据区域的划分步骤,包括:
根据所述时钟区域的大小和个数,将所述位流文件划分为若干位流子区域,每一位流子区域与每一时钟区域一一对应;
对于任一时钟区域和任一位流子区域,根据所述任一时钟区域中每一电路区域的数据位宽和地址位宽,将所述任一位流子区域划分为若干数据区域,每一数据区域与每一电路区域一一对应,所述任一时钟区域与所述任一位流子区域对应。
4.根据权利要求3所述的FPGA芯片验证方法,其特征在于,所述根据所述任一时钟区域中每一电路区域的数据位宽和地址位宽,将所述任一位流子区域划分为若干数据区域,包括:
对于任一电路区域,根据所述任一电路区域的数据位宽,确定横向位置;
根据所述任一电路区域的地址位宽,确定纵向位置;
根据所述横向位置和所述纵向位置,确定与所述任一电路区域对应的数据区域。
5.根据权利要求1至4任一所述的FPGA芯片验证方法,其特征在于,所述电路区域包括存储单元,所述配置点与所述存储单元的输出端口连接。
6.根据权利要求1至4任一所述的FPGA芯片验证方法,其特征在于,所述位流文件通过与所述目标FPGA芯片相对应的仿真软件得到。
7.一种FPGA芯片验证系统,其特征在于,包括:
映射模块,用于获取目标FPGA芯片和位流文件,所述目标FPGA芯片被划分为若干个电路区域,所述位流文件被划分为若干个数据区域,所述电路区域与所述数据区域一一对应;
验证模块,用于将每一数据区域中的数据强制赋值给对应电路区域的配置点,以对所述目标FPGA芯片进行仿真验证。
8.根据权利要求7所述的FPGA芯片验证系统,其特征在于,所述电路区域包括存储单元,所述配置点与所述存储单元的输出端口连接。
9.一种计算机设备,包括存储器、处理器以及存储在所述存储器中并可在所述处理器上运行的计算机程序,其特征在于,所述处理器执行所述计算机程序时实现如权利要求1至7中任一项所述FPGA芯片验证方法的步骤。
10.一种计算机存储介质,所述计算机存储介质存储有计算机程序,其特征在于,所述计算机程序被处理器执行时实现如权利要求1至7中任一项所述FPGA芯片验证方法的步骤。
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