[发明专利]SOI的有源区的隔离方法在审
申请号: | 202111097857.6 | 申请日: | 2021-09-18 |
公开(公告)号: | CN113948443A | 公开(公告)日: | 2022-01-18 |
发明(设计)人: | 张庆;关天鹏 | 申请(专利权)人: | 上海华力集成电路制造有限公司 |
主分类号: | H01L21/762 | 分类号: | H01L21/762 |
代理公司: | 上海浦一知识产权代理有限公司 31211 | 代理人: | 郭四华 |
地址: | 201203 上海市浦*** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | soi 有源 隔离 方法 | ||
1.一种SOI的有源区的隔离方法,其特征在于,包括如下步骤:
步骤一、提供一SOI衬底结构,所述SOI衬底包括半导体主体层,介质埋层和半导体顶层,所述介质埋层形成于所述半导体主体层表面,所述半导体顶层形成于所述介质埋层表面;在所述半导体顶层表面形成硬质掩膜层;
步骤二、对所述硬质掩膜层进行图形化刻蚀形成第一开口,所述第一开口将所述半导体顶层表面暴露;
步骤三、进行选择性外延生长在所述第一开口暴露的所述半导体顶层表面形成第一外延层,所述第一外延层从所述半导体顶层的表面开始由下往上生长,所述第一开口的侧面不生长所述第一外延层,所述第一外延层形成后会在所述第一开口的侧面处形成第一凹口;
步骤四、进行氧化工艺使所述第一外延层全部被氧化以及使所述第一凹口底部的所述半导体顶层也被氧化并最后形成第一氧化层,在所述第一凹口底部所述第一氧化层会穿过所述半导体顶层;
步骤五、去除所述硬质掩膜层和所述第一氧化层从而露出所述半导体顶层的顶部表面且在所述第一氧化层穿过所述半导体顶层的位置处形成隔离凹槽,所述隔离凹槽之间的所述半导体顶层作为有源区。
2.如权利要求1所述的SOI的有源区的隔离方法,其特征在于:所述SOI衬底为FDSOI衬底,形成于所述半导体顶层中的半导体器件工作时,栅极结构底部的所述半导体顶层的整个厚度会全部被耗尽。
3.如权利要求1或2所述的SOI的有源区的隔离方法,其特征在于:所述半导体主体层的材料包括硅或锗。
4.如权利要求1或2所述的SOI的有源区的隔离方法,其特征在于:所述介质埋层的材料包括氧化硅,高介电常数材料。
5.如权利要求1或2所述的SOI的有源区的隔离方法,其特征在于:所述半导体顶层的材料包括硅或锗。
6.如权利要求2所述的SOI的有源区的隔离方法,其特征在于:所述半导体顶层的厚度达5nm~20nm。
7.如权利要求2所述的SOI的有源区的隔离方法,其特征在于:所述硬质掩膜层由第二氧化层和第三氮化层叠加而成。
8.如权利要求7所述的SOI的有源区的隔离方法,其特征在于:所述第二氧化层的厚度为所述第三氮化层的厚度为
9.如权利要求7所述的SOI的有源区的隔离方法,其特征在于:步骤一中,采用扩散工艺或化学气相沉积工艺形成所述第二氧化层;
所述第三氮化层为采用扩散工艺形成的HCD氮化硅。
10.如权利要求7所述的SOI的有源区的隔离方法,其特征在于:步骤二的图形化刻蚀工艺包括如下分步骤:
步骤21、进行光刻工艺定义出所述第一开口的形成区域;
步骤22、根据光刻定义对所述硬质掩膜层进行刻蚀形成所述第一开口。
11.如权利要求10所述的SOI的有源区的隔离方法,其特征在于:步骤22中的刻蚀工艺包括:
进行干法刻蚀并停止在所述第二氧化层上;
进行湿法刻蚀将所述第二氧化层去除;
或者,步骤22中的刻蚀工艺包括:进行以所述半导体顶层为停止层的干法刻蚀以将所述第三氮化层和所述第二氧化层都去除。
12.如权利要求2所述的SOI的有源区的隔离方法,其特征在于:所述第一外延层的材料包括硅或锗。
13.如权利要求12所述的SOI的有源区的隔离方法,其特征在于:所述第一外延层的厚度为
14.如权利要求12所述的SOI的有源区的隔离方法,其特征在于:步骤四中的所述氧化工艺采用快速热氧化工艺。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造