[发明专利]智能存储装置在审
申请号: | 202111144318.3 | 申请日: | 2021-09-28 |
公开(公告)号: | CN114328306A | 公开(公告)日: | 2022-04-12 |
发明(设计)人: | 崔赫埈;田仑澔;刘永健;申孝德;郑二品 | 申请(专利权)人: | 三星电子株式会社 |
主分类号: | G06F13/16 | 分类号: | G06F13/16;G06F13/42 |
代理公司: | 北京铭硕知识产权代理有限公司 11286 | 代理人: | 张川绪;史泉 |
地址: | 韩国京畿*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 智能 存储 装置 | ||
1.一种智能存储装置,包括:
智能接口,连接到主机装置;
加速器电路,通过符合计算快速链路CXL.cache协议和/或CXL.mem协议的数据总线连接到智能接口,并且被配置为响应于主机装置的计算命令而执行加速计算;以及
存储控制器,通过符合CXL.io协议的数据总线连接到智能接口,并且被配置为响应于主机装置的数据访问命令而控制针对存储装置的数据访问操作,
其中,加速器电路能够通过直接连接到存储控制器的内部总线直接访问存储装置。
2.根据权利要求1所述的智能存储装置,其中,加速器电路包括:
命令解码器电路,被配置为通过对计算命令进行解码来提取计算信息;
计算模块,被配置为响应于解码后的计算命令而执行加速计算;
加速器存储器控制器电路,被配置为:将通过计算模块的操作生成的计算数据写入加速器存储器装置,或者从加速器存储器装置读取通过计算模块的操作生成的计算数据;
直接存储器存取引擎,连接到存储控制器以直接访问存储装置;以及
一致性引擎,被配置为保持存储在加速器存储器装置中的计算数据与存储在主机装置中的数据之间的一致性。
3.根据权利要求1所述的智能存储装置,其中,存储控制器包括:
调度器电路,被配置为:接收来自主机装置的第一访问请求和来自加速器电路的第二访问请求,并且根据预设策略调度用于处理第一访问请求和第二访问请求的操作的顺序;以及
控制单元电路,被配置为控制将数据写入存储装置或者从存储装置读取数据。
4.根据权利要求2所述的智能存储装置,其中,直接存储器存取引擎通过基于计算信息向存储控制器请求数据访问,来接收数据,
一致性引擎向主机装置请求对接收的数据的一致处理,并且
加速器存储器控制器电路将接收的数据存储在加速器存储器装置中。
5.根据权利要求2所述的智能存储装置,其中,
加速器存储器控制器电路读取存储在加速器存储器装置中的第一计算数据,
计算模块通过对第一计算数据执行加速计算来生成第二计算数据,并且
一致性引擎针对第二计算数据向主机装置请求一致处理。
6.根据权利要求5所述的智能存储装置,其中,当一致处理被完成时,加速器存储器控制器电路将第二计算数据写入加速器存储器装置,并且
计算模块向主机装置通知计算命令的完成。
7.一种智能存储装置,包括:
智能接口,连接到主机装置;
存储器控制器电路,通过符合计算快速链路CXL.io协议和/或CXL.mem协议的数据总线连接到智能接口,并且被配置为控制针对存储器装置的第一访问操作;以及
存储控制器,通过符合CXL.io协议的数据总线连接到智能接口,并且被配置为控制针对存储装置的第二访问操作,
其中,智能接口包括内部连接,内部连接直接连接符合CXL.mem协议和CXL.io协议的数据总线,以直接访问存储器控制器电路和存储控制器。
8.根据权利要求7所述的智能存储装置,还包括:
路由器,连接到符合CXL.io协议的数据总线;
存储器协议处理器,连接到路由器和符合CXL.mem协议的数据总线,以将用于第一访问操作的请求发送和返回到存储器控制器电路;以及
存储协议处理器,连接到路由器,以发送和返回用于第二访问操作的请求。
9.根据权利要求8所述的智能存储装置,其中,存储协议处理器对从主机装置接收的访问命令进行解析,并且检查请求的数据的地址。
10.根据权利要求9所述的智能存储装置,其中,当请求的数据的地址是存储器装置的地址时,存储协议处理器通过内部连接将访问命令传送到存储器协议处理器。
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