[发明专利]半导体器件的形成方法在审
申请号: | 202111292206.2 | 申请日: | 2021-11-03 |
公开(公告)号: | CN114121663A | 公开(公告)日: | 2022-03-01 |
发明(设计)人: | 邱岩栈 | 申请(专利权)人: | 上海华力集成电路制造有限公司 |
主分类号: | H01L21/336 | 分类号: | H01L21/336;H01L29/423 |
代理公司: | 上海浦一知识产权代理有限公司 31211 | 代理人: | 黎伟 |
地址: | 201203*** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | 半导体器件 形成 方法 | ||
1.一种半导体器件的形成方法,其特征在于,包括:
提供一衬底,所述衬底上所述半导体器件的有源区中形成有第一栅极结构和第二栅极结构,所述第一栅极结构从下而上依次包括第一栅极、第一硬掩模层和第二硬掩模层,所述第二栅极结构从下而上依次包括第二栅极、第三硬掩模层和第四硬掩模层,所述第一栅极结构之间形成有第一嵌入式外延层,所述第二栅极结构之间形成有第二嵌入式外延层,所述第一栅极和所述衬底之间形成有栅介电层,所述第二栅极和所述衬底之间形成有栅介电层,所述第一栅极结构和所述第二栅极结构的两侧形成有隔离层,所述第二栅极结构的高度高于所述第一栅极结构的高度;
形成刻蚀停止层,所述刻蚀停止层覆盖所述衬底、所述第一栅极结构、所述第一嵌入式外延层、所述第二栅极结构、所述第二嵌入式外延层和所述隔离层所暴露的表面;
在所述刻蚀停止层表面形成第一介电层,所述第一介电层高于所述第二栅极结构且填充所述第一栅极结构和所述第二栅极结构周侧的间隙;
进行第一次刻蚀,使所述第一介电层的高度低于所述第二硬掩模层的高度和所述第四硬掩模层的高度;
形成平坦化停止层,所述平坦化停止层覆盖所述第一介电层和所述第二硬掩模层、所述第四硬掩模层所暴露的表面;
去除第二区域的平坦化停止层,所述第二区域是所述有源区中形成所述第二栅极结构的区域;
形成第二介电层,所述第二介电层覆盖所述第一介电层、所述平坦化停止层和所述刻蚀停止层;
进行平坦化处理,直至所述平坦化停止层暴露;
进行第二次刻蚀,直至所述第一硬掩模层和所述第二硬掩模层暴露。
2.根据权利要求1所述的方法,其特征在于,所述去除第二区域的平坦化停止层,包括:
通过光刻工艺在除所述第二区域以外的其它区域覆盖光阻;
刻蚀去除所述第二区域的平坦化停止层;
去除所述光阻。
3.根据权利要求2所述的方法,其特征在于,所述平坦化停止层包括氮化硅层,所述刻蚀停止层包括碳氮化硅层;
所述刻蚀去除所述第二区域的平坦化停止层,包括:
通过湿法刻蚀工艺去除所述第二区域的平坦化停止层。
4.根据权利要求3所述的方法,其特征在于,所述第一介电层包括二氧化硅层。
5.根据权利要求4所述的方法,其特征在于,所述第二介电层包括二氧化硅层。
6.根据权利要求1至5任一所述的方法,其特征在于,所述第一嵌入式外延层包括硅锗外延层。
7.根据权利要求6所述的方法,其特征在于,所述第二嵌入式外延层包括硅磷外延层。
8.根据权利要求7所述的方法,其特征在于,所述第一硬掩模层和所述第三硬掩模层包括氮化硅层。
9.根据权利要求8所述的方法,其特征在于,所述第二硬掩模层和所述第四硬掩模层包括二氧化硅层。
10.根据权利要求9所述的方法,其特征在于,所述隔离层包括碳氮氧化硅层。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造