[发明专利]一种低延迟视频处理方法、系统及装置在审

专利信息
申请号: 202210287130.2 申请日: 2022-03-22
公开(公告)号: CN114866733A 公开(公告)日: 2022-08-05
发明(设计)人: 孙杰;周京波;侯连勇 申请(专利权)人: 感知信息科技(浙江)有限责任公司
主分类号: H04N7/18 分类号: H04N7/18;H04N7/01;H04N19/174
代理公司: 成都鱼爪智云知识产权代理有限公司 51308 代理人: 谷科均
地址: 315806 浙江省宁*** 国省代码: 浙江;33
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摘要:
搜索关键词: 一种 延迟 视频 处理 方法 系统 装置
【说明书】:

发明提出了一种低延迟视频处理方法、系统及装置,涉及视频处理的技术领域。包括通过LVDS摄像头采集的视频帧数据,并将视频帧数据通过解串器解串为MIPI‑CSI2接口协议数据,而后送入MIPI子系统处理;将MIPI子系统进行接口数据处理完成后的视频帧数据,再进行格式转换、同步以及切片编码;将编码完成的视频帧数据通过5G网络发送至远程平台端。其能够解决现有视频处理系统数据延迟较高的问题。

技术领域

本发明涉及视频处理的技术领域,具体而言,涉及一种低延迟视频处理方法、系统及装置。

背景技术

随着社会的不断发展,视频处理技术在许多行业领域中扮演着非常重要的角色,如军事、安全监控、工业视觉等领域。目前,相关的集成硬件,如DSP、ARM、FPGA等,对视频进行采集处理具有实时性好、体积小、方便使用的优点。但是处于对实时性要求比较高的场合时,需要实时针对运动情况做出处理,此时需要将视频数据以最快的传输速度传输给远程平台端,而远程平台端根据不同的情况做出响应。这就需要视频采集处理具有极低的延迟特性,并且视频数据在采集系统中保持实时。由此需要一种低延迟视频处理方法、系统及装置。

发明内容

本发明的目的在于提供一种低延迟视频处理方法,其能够解决现有视频处理系统数据延迟较高的问题。

本发明的实施例是这样实现的:

第一方面,本申请实施例提供一种低延迟视频处理方法,包括通过LVDS摄像头采集的视频帧数据,并将视频帧数据通过解串器解串为MIPI-CSI2接口协议数据,而后送入MIPI子系统处理;将MIPI子系统进行接口数据处理完成后的视频帧数据,再进行格式转换、同步以及切片编码;将编码完成的视频帧数据通过5G网络发送至远程平台端。

在本发明的一些实施例中,切片编码的步骤包括:将采集的视频帧数据进行切片处理,得到多个分片,然后将任一分片进行编码;将完成编码后的数据以片段的模式进行输出,在片段的每一端生成一个片段完成中断,并为片段输出流缓存,流缓存用于下一个元素处理,从而将视频编码时延,将多个片段逐帧减少。

在本发明的一些实施例中,然后将任一分片进行编码的步骤包括:对接收到任一分片进行实时编码,实时编码无需等待完整的一帧的分片到来再进行编码。

在本发明的一些实施例中,将MIPI子系统进行接口数据处理完成后的视频帧数据,再进行格式转换、同步以及切片编码的步骤包括:将MIPI子系统进行接口数据处理完成后的视频帧数据,送入编码操作的传输链路中采用DMA传输,并进行零拷贝处理。

第二方面,本申请实施例提供一种低延迟视频处理系统,其包括数据接收模块,用于通过LVDS摄像头采集的视频帧数据,并将视频帧数据通过解串器解串为MIPI-CSI2接口协议数据,而后送入MIPI子系统处理;数据处理模块,用于将MIPI子系统进行接口数据处理完成后的视频帧数据,再进行格式转换、同步以及切片编码;数据发送模块,用于将编码完成的视频帧数据通过5G网络发送至远程平台端。

在本发明的一些实施例中,数据接收模块将采集的视频帧数据进行切片处理,得到多个分片,然后将任一分片送入数据处理模块中的编码模块进行编码;将完成编码后的数据以片段的模式进行输出,在片段的每一端生成一个片段完成中断,并为片段输出流缓存,流缓存用于下一个元素处理,从而将视频编码时延,将多个片段逐帧减少。

在本发明的一些实施例中,数据接收模块采用解串器与SOC(ARM+FPGA)芯片中的FPGAMIPI子系统的IP核进行对接;数据处理模块采用SOC(ARM+FPGA)芯片中的FPGA视频子系统VPSS以及编解码单元VCU的IP核进行处理。

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