[发明专利]用于在读取操作期间控制数据选通信号的系统及方法在审

专利信息
申请号: 202210403418.1 申请日: 2019-04-16
公开(公告)号: CN114582389A 公开(公告)日: 2022-06-03
发明(设计)人: 高桥继雄 申请(专利权)人: 美光科技公司
主分类号: G11C11/4076 分类号: G11C11/4076;G11C11/408;G11C11/4093;G11C11/4096;G11C7/10
代理公司: 北京律盟知识产权代理有限责任公司 11287 代理人: 王龙
地址: 美国爱*** 国省代码: 暂无信息
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摘要:
搜索关键词: 用于 读取 操作 期间 控制 数据 通信 系统 方法
【权利要求书】:

1.一种设备,其包括:

数据选通DQS状态控制电路,其经配置以至少部分地响应于将读取时钟信号供应到所述DQS状态控制电路的控制逻辑而将至少一个控制信号设置为有效状态,所述DQS状态控制电路进一步经配置以在已暂停将所述读取时钟信号供应到所述DQS状态控制电路的所述控制逻辑之后将所述至少一个控制信号维持在所述有效状态;及

输出缓冲器电路,其经配置以接收所述至少一个控制信号及所述读取时钟信号,所述输出缓冲器电路进一步经配置以至少部分地基于所述至少一个控制信号的所述有效状态而激活以至少部分地响应于所述读取时钟信号而驱动数据选通DQS端子,使得所述输出缓冲器电路在已暂停将所述读取时钟信号供应到所述DQS状态控制电路的所述控制逻辑之后继续驱动所述DQS端子。

2.根据权利要求1所述的设备,其中所述DQS状态控制电路包括门电路,所述门电路经配置以接收所述读取时钟信号及读取时钟启用信号且响应于所述读取时钟启用信号的状态而控制所述读取时钟信号到所述DQS状态控制电路的所述控制逻辑的供应。

3.根据权利要求2所述的设备,其中所述DQS状态控制电路的所述控制逻辑经配置以接收所述门电路的输出且将所述至少一个控制信号输出到所述输出缓冲器电路。

4.根据权利要求1所述的设备,其中所述输出缓冲器电路包括DQS输出缓冲器上拉驱动器及DQS输出缓冲器下拉驱动器。

5.根据权利要求4所述的设备,其中所述至少一个控制信号包括第一控制信号及第二控制信号,其中所述DQS输出缓冲器上拉驱动器经配置以从所述DQS状态控制电路接收所述第一控制信号,且其中所述DQS输出缓冲器下拉驱动器经配置以从所述DQS状态控制电路接收所述第二控制信号。

6.根据权利要求1所述的设备,其中暂停以非突发读取模式将所述读取时钟信号供应到所述DQS状态控制电路的所述控制逻辑。

7.根据权利要求1所述的设备,其中暂停以突发读取模式将所述读取时钟信号供应到所述DQS状态控制电路的所述控制逻辑。

8.根据权利要求1所述的设备,其中暂停以非突发读取模式及突发读取模式两者将所述读取时钟信号供应到所述DQS状态控制电路的所述控制逻辑。

9.根据权利要求1所述的设备,其中所述DQS状态控制电路进一步经配置以在已恢复将所述读取时钟信号供应到所述DQS状态控制电路的所述控制逻辑之后将所述至少一个控制信号维持在所述有效状态,使得所述输出缓冲器电路在已恢复将所述读取时钟信号供应到所述DQS状态控制电路的所述控制逻辑之后继续驱动所述DQS端子。

10.一种设备,其包括:

输出缓冲器电路,其经配置以选择性地将读取时钟信号传递到输出端;以及

控制逻辑,其经配置以选择性地接收所述读取时钟信号,并且:

在第一周期期间,将所述输出缓冲器电路置于有效状态;

在第二周期期间,将所述输出缓冲器电路维持在所述有效状态;以及

在第三周期期间,将所述输出缓冲器电路置于无效状态;

其中当处于所述有效状态时,所述输出缓冲器电路经配置以允许所述读取时钟信号传递到所述输出端;

其中所述控制逻辑经配置以至少响应于所述读取时钟信号而将所述输出缓冲器电路置于所述有效状态或所述无效状态;以及

其中防止所述控制逻辑在所述第二周期的至少一部分期间接收所述读取时钟信号。

11.根据权利要求10所述的设备,其中所述第二周期在突发读取模式操作期间。

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