[发明专利]时序转换装置、方法、写入均衡系统及计算机可读取介质在审
申请号: | 202210699757.9 | 申请日: | 2022-06-20 |
公开(公告)号: | CN115021725A | 公开(公告)日: | 2022-09-06 |
发明(设计)人: | 赖荣钦 | 申请(专利权)人: | 东芯半导体股份有限公司 |
主分类号: | H03K5/00 | 分类号: | H03K5/00;G11C11/4063;G11C11/4096 |
代理公司: | 上海专利商标事务所有限公司 31100 | 代理人: | 陈力奕 |
地址: | 201799 上海市青浦区徐泾*** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | 时序 转换 装置 方法 写入 均衡 系统 计算机 读取 介质 | ||
1.一种时序转换装置,其特征在于,包括:
时间数字转换单元,该时间数字转换单元从外部获取具有第一周期的第一信号,基于所述第一周期来生成粗码;
细码调整单元,该细码调整单元从所述时间数字转换单元获取所述粗码,并向所述时间数字转换单元输出细码以用于所述粗码的生成,当所述粗码不是Y的整数倍时,对所述细码进行调整,直至所述粗码成为Y的整数倍,其中,Y为正整数;
乘法单元,该乘法单元从所述时间数字转换单元获取所述粗码,对所述粗码的X/Y倍进行计算,其中,X为正整数;以及
数字时间转换单元,该数字时间转换单元从所述细码调整单元获取所述细码,从所述乘法单元获取所述粗码的X/Y倍,并从外部获取第二信号,基于所述粗码的X/Y倍及所述细码,将所述第二信号延迟所述第一周期的X/Y倍并输出至外部。
2.如权利要求1所述的时序转换装置,其特征在于,
所述时间数字转换单元包括多个具有第一延迟时间的第一延迟部,通过将所述第一周期除以所述第一延迟时间并取整,来计算所述第一延迟部的使用个数,所述粗码与所述第一延迟部的使用个数相对应,
所述细码调整单元通过调整所述细码来对各所述第一延迟部的所述第一延迟时间的长度进行同步调整,直至所述粗码成为Y的整数倍。
3.如权利要求2所述的时序转换装置,其特征在于,
所述数字时间转换单元包括多个具有所述第一延迟时间的第二延迟部,基于所述粗码的X/Y倍来计算所述第二延迟部的使用个数,并基于所述细码来同步调整各所述第二延迟部的所述第一延迟时间的长度,使所述第二信号通过所使用的所述第二延迟部,来将所述第二信号进行延迟。
4.如权利要求3所述的时序转换装置,其特征在于,
所述时间数字转换单元还包括编码部,该编码部对所述第一延迟部的使用个数进行编码,以生成所述粗码,
所述数字时间转换单元还包括解码部,该解码部对所述粗码的X/Y倍进行解码,以生成所述第二延迟部的使用个数。
5.如权利要求2或3所述的时序转换装置,其特征在于,
所述细码调整单元通过调整所述细码,将所述第一延迟时间变长。
6.如权利要求2或3所述的时序转换装置,其特征在于,
所述细码调整单元通过调整所述细码,将所述第一延迟时间变短。
7.如权利要求1至4的任一项所述的时序转换装置,其特征在于,
所述第一周期是时钟信号周期,
且X/Y=1/4。
8.一种写入均衡系统,该写入均衡系统用于存储器的数据写入,其特征在于,包括:
写入延时模块,该写入延时模块接收写入命令和时钟信号,根据所述写入命令对所述时钟信号进行延时;
如权利要求1至7的任一项所述的时序转换装置,该时序转换装置将数据选通信号延迟所述时钟信号的周期的X/Y倍;以及
信号对齐模块,该信号对齐模块利用经所述时序转换装置延迟后的所述数据选通信号的上升沿,对经所述写入延时模块延时后的所述时钟信号进行采样,当未采样到所述时钟信号从低电平跳变至高电平时,向所述时序转换装置发送控制指令来对X/Y进行调整,当采样到所述时钟信号从低电平跳变至高电平时,输出延迟后的所述数据选通信号以用于所述存储器的数据写入。
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