[发明专利]具有DQS脉冲控制电路系统的存储器以及相关联的系统、装置和方法在审
申请号: | 202210984943.7 | 申请日: | 2022-08-17 |
公开(公告)号: | CN116110476A | 公开(公告)日: | 2023-05-12 |
发明(设计)人: | 金美昭;S·E·史密斯;金始弘 | 申请(专利权)人: | 美光科技公司 |
主分类号: | G11C16/32 | 分类号: | G11C16/32;G11C16/10;G11C7/10 |
代理公司: | 北京律盟知识产权代理有限责任公司 11287 | 代理人: | 王龙 |
地址: | 美国爱*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 具有 dqs 脉冲 控制电路 系统 存储器 以及 相关 装置 方法 | ||
1.一种存储器装置,其包括:
外部端子,其被配置成接收包含具有第一脉冲宽度的第一脉冲的外部定时信号;以及
电路系统,其可操作地耦合到所述外部端子,其中所述电路系统被配置成:
至少部分地基于所述第一脉冲而产生第二脉冲,其中所述第二脉冲具有大于所述第一脉冲宽度的第二脉冲宽度,并且
输出包含所述第二脉冲的内部定时信号。
2.根据权利要求1所述的存储器装置,其中所述电路系统包含延迟元件,并且所述第二脉冲宽度至少部分地对应于由所述延迟元件施加在所述电路系统内所传输的信号上的延迟。
3.根据权利要求1所述的存储器装置,其中所述第二脉冲宽度等同于所述外部定时信号的周期的一半的最小脉冲宽度。
4.根据权利要求1所述的存储器装置,其中所述电路系统包含:
置位/复位SR锁存器;以及
延迟元件,其可操作地耦合到所述SR锁存器的输出。
5.根据权利要求4所述的存储器装置,其中所述电路系统进一步包含:
第一反相器,其具有可操作地耦合到所述SR锁存器的第一输入的输出;以及
第二反相器,其中所述第二反相器可操作地耦合到所述延迟元件,包含可操作地耦合到所述SR锁存器的所述输出的输入,并且包含可操作地耦合到所述SR锁存器的第二输入的输出。
6.根据权利要求5所述的存储器装置,其中所述SR锁存器进一步包含可操作地耦合到复位信号的第三输入。
7.根据权利要求1所述的存储器装置,其中:
所述外部定时信号包含具有大于所述第二脉冲宽度的第三脉冲宽度的第三脉冲;并且
所述电路系统进一步被配置成:
至少部分地基于所述第三脉冲而产生第四脉冲,其中所述第四脉冲具有等同于所述第三脉冲宽度的第四脉冲宽度,并且
输出包含所述第四脉冲的所述内部定时信号。
8.根据权利要求1所述的存储器装置,其中所述第一脉冲在所述外部定时信号上振铃。
9.根据权利要求1所述的存储器装置,其进一步包括输入缓冲器,所述输入缓冲器具有可操作地耦合到所述外部端子的输入以及可操作地耦合到所述电路系统的输入的输出。
10.根据权利要求1所述的存储器装置,其进一步包括被配置成接收写入数据的数据DQ端子。
11.根据权利要求10所述的存储器装置,其中所述存储器装置被配置成至少部分地基于由从所述电路系统输出的所述内部定时信号所定义的定时而对在所述DQ端子处接收的所述写入数据进行取样。
12.根据权利要求11所述的存储器装置,其中所述外部端子包含数据选通DQS端子,其中所述外部定时信号包含外部DQS信号,并且其中所述内部定时信号包含内部DQS信号。
13.一种存储器系统,其包括:
存储器控制器;以及
存储器装置,其可操作地连接到所述存储器控制器,其中所述存储器装置包含:
外部端子,其被配置成从所述存储器控制器接收外部定时信号,所述外部定时信号包含具有第一脉冲宽度的第一脉冲;以及
电路系统,其可操作地耦合到所述外部端子,其中所述电路系统被配置成:
至少部分地基于所述第一脉冲而产生第二脉冲,其中所述第二脉冲具有大于所述第一脉冲宽度的第二脉冲宽度,并且
输出包含所述第二脉冲的内部定时信号。
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