[发明专利]嵌入式芯片扇出型封装结构及其制备方法在审
申请号: | 202310959643.8 | 申请日: | 2023-08-01 |
公开(公告)号: | CN116666231A | 公开(公告)日: | 2023-08-29 |
发明(设计)人: | 华显刚;贺姝敏 | 申请(专利权)人: | 广东佛智芯微电子技术研究有限公司 |
主分类号: | H01L21/50 | 分类号: | H01L21/50;H01L21/56;H01L21/60;H01L23/488;H01L23/31 |
代理公司: | 深圳珠峰知识产权代理有限公司 44899 | 代理人: | 黄伟 |
地址: | 528225 广东省佛山市南海区狮山镇*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 嵌入式 芯片 扇出型 封装 结构 及其 制备 方法 | ||
1.一种嵌入式芯片扇出型封装结构的制备方法,其特征在于,包括以下步骤:
S10、提供基板,在所述基板上开设若干第一通孔和若干设计尺寸大于芯片尺寸的嵌入槽;
S20、将所述基板的第一面贴于临时胶膜上,并将芯片贴于所述嵌入槽内;
S30、在所述基板的第一面和第二面分别制备介电层,并使介电层填充于所述第一通孔内和所述芯片与所述基板之间的间隙内,对所述介电层进行处理,使所述芯片的I/O口外露,制得芯片封装体;
S40、在填充于所述第一通孔内的介电层处开设第二通孔;
S50、将所述芯片的I/O口经所述第二通孔由所述芯片封装体的双面同步电性引出,制得嵌入式芯片扇出型封装结构。
2.根据权利要求1所述的嵌入式芯片扇出型封装结构的制备方法,其特征在于,步骤S20中,所述芯片的I/O口凸出于所述芯片的表面,将所述芯片正面朝上贴于所述嵌入槽内后,步骤S30具体包括以下步骤:
S30a、在所述基板的第二面制备第一介电层;
S30b、对所述第一介电层进行研磨减薄处理,使所述芯片的I/O口外露;
S30c、去除临时胶膜;
S30d、在所述基板的第一面制备第二介电层,制得芯片封装体。
3.根据权利要求1所述的嵌入式芯片扇出型封装结构的制备方法,其特征在于,步骤S20中,所述芯片的I/O口与所述芯片的表面平齐,将所述芯片正面朝上贴于所述嵌入槽内后,步骤S30具体包括以下步骤:
S30a、在所述基板的第二面制备第一介电层;
S30b、对所述第一介电层进行激光开孔处理,使所述芯片的I/O口外露;
S30c、去除临时胶膜;
S30d、在所述基板的第一面制备第二介电层,制得芯片封装体。
4.根据权利要求1所述的嵌入式芯片扇出型封装结构的制备方法,其特征在于,步骤S20中,所述芯片的I/O口与所述芯片的表面平齐,将所述芯片正面朝下贴于所述嵌入槽内时,步骤S30具体包括以下步骤:
S30a、在所述基板的第二面制备第一介电层;
S30b、去除临时胶膜;
S30c、在所述基板的第一面制备第二介电层;
S30d、对所述第二介电层进行激光开孔处理,使所述芯片的I/O口外露,制得芯片封装体。
5.根据权利要求1所述的嵌入式芯片扇出型封装结构的制备方法,其特征在于,步骤S50具体包括以下步骤:
S50a、在芯片封装体的表面以及所述第二通孔内壁制作种子层;
S50b、在芯片封装体表面的种子层上贴感光膜,曝光显影后形成图形化窗口;
S50c、在图形化窗口内及第二通孔内壁制备重布线层;
S50d、去除残留的感光膜并刻蚀掉外露的种子层;
S50e、在所述第二通孔内及制备有重布线层的芯片封装体的双面制备阻焊层并使重布线层的焊盘区外露;
S50f、在重布线层的焊盘区制备镍钯金层,并在镍钯金层植入金属凸块,制得嵌入式芯片扇出型封装结构。
6.根据权利要求1-5任一项所述的嵌入式芯片扇出型封装结构的制备方法,其特征在于,所述基板为BT板、不锈钢板、玻璃材质或FR-3材质。
7.根据权利要求1-5任一项所述的嵌入式芯片扇出型封装结构的制备方法,其特征在于,步骤S40中,采用激光在填充于所述第一通孔内的介电层处开设第二通孔。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造