[其他]彩色信号阶跃增陡电路无效
申请号: | 86101799 | 申请日: | 1986-03-20 |
公开(公告)号: | CN86101799A | 公开(公告)日: | 1986-10-15 |
发明(设计)人: | 彼得·迈克尔·弗拉姆;罗夫·迪尤伯特 | 申请(专利权)人: | 德国ITT工业有限公司 |
主分类号: | H04N9/77 | 分类号: | H04N9/77 |
代理公司: | 中国国际贸易促进委员会专利代理部 | 代理人: | 陆丽英 |
地址: | 联邦德国弗*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 彩色 信号 阶跃 电路 | ||
本发明涉及一种用于彩色电视接收机的彩色信号阶跃增陡电路。它包括一个斜率检测器,当信号超过某一预定的幅度阈值时,斜率检测器就发出一个切换信号使两个色差信道在其系统上升期间分别输出一个替代信号。这种能改善彩色信号阶跃的电路在VALVO发表的题为“技术信息840228(即1984年2月28日):采用TDA4560电路延迟彩色信号和亮度信号以增陡斜度”一文中已予说明。
色差信道带宽要比亮度信道带宽窄得多,目前采用的电视标准规定约为亮度信道带宽的1/5。这就导致在彩色信号突变时造成彩色阶跃模糊不清(称为“彩色镶边”),例如在彩条测试信号的边沿处可以看到,这是因为与其在一起的亮度信号相比,其传输通带太窄,而彩色信号阶跃约需五倍的持续时间,所以会产生上述情况。先有技术电路使彩色信号的慢升沿变陡主要是由于应用了适当的模拟电路(因为色差信号和亮度信号往往是以模拟信号的形式出现并予以处理的),通过适当地延迟色差信号和亮度信号,并在延迟终了时将色差信号的边沿增陡的途径来实现的。
本发明要解决的问题就是以下述方式来修改先有技术应用模拟电路的原则,即在现有的彩色电视接收机中采用带有斜率检测器的数字信号处理电路(参阅“电子学”1981年8月11日第9至103页),它不仅符合先有技术电路所符合的有某一预定的幅度阈值的标准,而且还符合另一附加的标准。
远在解决此问题所具有的优点以外的其它一些优点将从以下本发明的说明并结合附图就会看得更清楚。
图1是本发明的第一实施例的方框图。
图2是图1实施例改进电路的方框图。
图3是图1和图2的斜率检测器的实施方框图。
图4示出说明本发明基本工作的各种波形图。
图5示出说明图2改进电路工作的各种波形图。
参见图1,数字色差信号yr、yb是以时钟信号f(它是彩色信号副载波频率的四倍)的频率在基带中出现,也就是说,各数据字以此频率一个接一个地出现。如果时钟信号f的次谐波(即此彩色副载波频率自身就是一例)被选作色差信号的解调频率,就象现有的数字彩色电视机那样,这些数字信号必须用数字内插法带到上述时钟信号f的重复频率上。
图1中有二个分别为色差信号yr、yb设置的分路,这两个分路设计得完全相同。Z1分路为色差信号R-Y信道,Z2分路为色差信号B-Y信道。在Z1分路里,R-Y色差信号yr被送到第一延迟部件v1和第一数字斜率检测器fs1的输入端。第一延迟部件v1的输出端连到第一存储器s1和第一开关us1的输入端,而第一存储器s1的输出端连到第一开关us1的另一个输入端。us1的输出端连到第一输出寄存器r1的输入端。
就各个分路的各种电路及其各电路的相互连接而言,B-Y色差信号yb用的第二分路Z2设计得与第一分路z1完全相同,它包括第二数字斜率检测器fs2、第二延迟部件v2,第二存储器s2、第二开关us2和第二输出寄存器r2。
二个斜率检测器fs1、fs2的输出信号分别送到“或”门og的第一、第二输入端,“或”门og的输出端连到程序控制器ab的第一输入端。后者的第二输入端是时钟信号f,其第三输入端是数字信号hz,用此信号可将保持时间预置得等于色差信道系统的上升时间。程序控制器ab的输出端连到第一、第二存储器s1、s2和第一、第二输出寄存器r1、r2的“许可”输入端en,还连接到二个开关us1、us2的控制输入端。
程序控制器ab这样控制这些子电路,在保持时间内某一中间值时出现的R-Y信号值yr1和B-Y信号值yb1分别被读入存储器s1和s2。此保持时间的中间值最好是处于保持时间的正中。此外,在增陡前沿相应于此中间值处,最好是在其半幅值处,程序控制器将存储器s1和s2的存储内容分别经过相关的开关us1和us2送入相关的输出寄存器r1和r2,而除了在此增陡前沿中间值的瞬间以外的全部时间,相关的输出寄存器r1、r2的输入端则一直分别接在延迟部件v1和v2的输出端上。
图2的方框图示出图1实施例的改进电路,实际上改进部分主要包括:图1中的第一、第二存储器s1、s2又补充了第三、第四存储器s3、s4,s3、s4分别地与相关的存储器s1、s2并联连接;图1中的二个开关us1、us2扩展成多位开关us1′、us2′,每个开关附加一位,其输入端分别连到第三存储器s3和第四存储器s4的输出端。
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