[发明专利]环状结构的多路译码电路及其方法无效
| 申请号： | 98103481.0 | 申请日： | 1998-08-05 |
| 公开（公告）号： | CN1099765C | 公开（公告）日： | 2003-01-22 |
| 发明（设计）人： | 谢磊;仇佩亮;王匡 | 申请（专利权）人： | 国家科学技术委员会高技术研究发展中心 |
| 主分类号： | H03M7/00 | 分类号： | H03M7/00 |
| 代理公司： | 北京邦大专利事务所 | 代理人： | 魏殿绅 |
| 地址： | 100862 *** | 国省代码： | 北京;11 |
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| 摘要： | |||
| 搜索关键词： | 环状 结构 译码 电路 及其 方法 | ||
【权利要求书】：
1、一种环状结构的多路译码电路，具有一个高速译码器，其特征在于还具有一个译码状态表，所述的高速译码器和译码状态表构成一个环状结构，其中译码状态表是一个由12级串联的D触发器组构成，相当于一个12级的移位寄存器，来自编码器的各译码器的状态数据经移位寄存器被输入到高速译码器中。
2、一种环状结构的多路译码的方法，采用一个高速译码器和一个12级的移位寄存器，所述的高速译码器和一个12级的移位寄存器构成一个环状结构，其特征在于：首先来自编码器的各译码器的状态数据依次在寄存器中列队，然后，再将此列的状态数据队列的头部的当前译码器的状态数据依次输入到高速译码器内；由高速译码器计算所得的新的状态数据重新排在队尾以待下一周期使用。
3、由权利要求2所述的环状结构的多路译码的方法，其特征在于所述的数个译码器的状态信息以循环队列的形式排列。
4、由权利要求3所述的环状结构的多路译码的方法，其特征在于所述循环队列设置有与编码器数量相对应的级。
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