[发明专利]采用可编程延迟来控制地址缓冲器的存储器有效
| 申请号： | 00121974.X | 申请日： | 2000-07-27 |
| 公开（公告）号： | CN1303102A | 公开（公告）日： | 2001-07-11 |
| 发明（设计）人： | 威廉·罗伯特·韦尔;常瑞;格林·斯塔尼斯 | 申请（专利权）人： | 摩托罗拉公司 |
| 主分类号： | G11C11/4063 | 分类号： | G11C11/4063;G11C11/413;G11C7/00 |
| 代理公司： | 中国国际贸易促进委员会专利商标事务所 | 代理人： | 付建军 |
| 地址： | 美国伊*** | 国省代码： | 暂无信息 |
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| 摘要： | 一种采用可编程延迟电路控制地址缓冲器的存储器。为该存储器件的每个模块设置可编程延迟电路。由全局熔断电路对每个模块进行延迟编程。在将存储器件制造在集成电路(IC)上之后,在各种电压和温度条件下测量每个模块内的所有数据路径,以识别存储器件所有模块中最慢的数据路径。全局熔断电路也用于对该时钟控制电路内的延迟器件编程,以使时钟控制电路和数据块内的程序延迟基本上相同。 | ||
| 搜索关键词： | 采用 可编程 延迟 控制 地址 缓冲器 存储器 | ||
【主权项】：
1．一种存储器，其特征在于：一个地址缓冲器，具有用于接收地址信号(ADDR)的输入端，提供真地址信号(A)的第一输出端；提供互补地址信号(AB)的第二输出端；和控制输入端；多个熔丝(110)，用于提供延迟程序(DC)信号；时钟电路(106)，具有接收外部时钟(KPAD)的输入端和输出端(KR/W)；可编程脉冲宽度电路(108)，具有耦合到时钟电路的输出端的第一输入端，接收延迟程序信号的第二输入端，和耦合到地址缓冲器的控制输入端的输出端；响应启动信号启动的字线驱动器；响应延迟的启动信号启动的检测放大器；和响应该启动信号提供延迟的启动信号的可编程延迟电路，其中可编程延迟电路具有与可编程脉冲宽度电路产生的脉冲的宽度相同的延迟；其中地址缓冲器响应被禁止的控制输入端使真和互补地址信号处在相同逻辑状态。
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